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[参考译文] TL16C752D:接收 FIFO 变空时的接收中断清除方式(2)

Guru**** 2392095 points
Other Parts Discussed in Thread: TL16C752D

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/903121/tl16c752d-receive-interrupt-clear-way-when-receive-fifo-becomes-empty-2

器件型号:TL16C752D

大家好、

 *这是线程 TL16C752D 的延续:当接收 FIFO 变空时接收中断清除方式。

我的客户发现 TL16C752DPFBRQ1的接收中断无法清除、这种现象似乎是造成这种情况的原因。
地址总线在 CPU 到 TL16C752D 的读取周期结束时被释放、但是在释放时会出现类似尖峰的噪声、并且连接到 TL16C752D 的地址信号会发生变化。
他们 认为这可能是因为 TL16C752D 的"地址保持时间"最小值7ns 的要求不满足。
(TL16C752B 的地址保持时间最小为0ns)

通过使用仿真、在读取 TL16C752D 上的接收中断导致的 RHR 时、是否无法确认"如果地址保持时间不满足所需规格、则不清除中断输出"的现象最小值7ns?
您的能力。

此致、

Koshi Ninomiya

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    您好、Ninomiya-San、

    为了让我们更好地了解器件可能受到的影响、是否可以查看显示尖峰的捕获波形-如噪声?

    此致、

    最大

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    尊敬的 Max-San:

    显示类似尖峰噪声的捕获波形如下所示、

    e2e.ti.com/.../TL16C752DPFBRQ1-Spike_2D00_like-Noise.pdf 

    此致、

    Koshi Ninomiya

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    尼诺米亚-圣、

    感谢您提供更多详细信息。  我认为这种理论是有道理的。  如果器件感应到的地址设置在/CS 边沿之后不久发生变化、并且违反了保持时间要求、则读取操作可能未成功完成。  在这种情况下、它可以解释为什么最后一个字节可以被多次读取并且中断不会按预期取消置位。  是否可以防止这种干扰、例如使用下拉电阻、并验证读取操作是否按预期工作?

    此致、
    最大

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    尊敬的 Max-San:

    客户确认读操作正常、可以防止出现毛刺脉冲。
    谢谢你。

    此致、

    Koshi Ninomiya