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[参考译文] DP83867CR:澄清了 RX 时序预算

Guru**** 2538930 points
Other Parts Discussed in Thread: DP83867CR

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/770723/dp83867cr-rx-timing-budget-clarification

器件型号:DP83867CR

大家好、

我的客户遇到了 DP83867CR 的一些问题、这些问题主要与接收数据有关。 为了确定根本原因、我们将根据 SNLA243研究 RGMII 接口的时序预算。

本文档提供了一个示例和一些规格来确定 TX 时序预算;但是、我们也有兴趣了解 RX 时序预算。 我想对以下时序参数进行一些澄清、并了解它们是否适用于 RX 接口:

  • Idvar = 0.2ns (对于 TX)-->对于 RX 接口上的 DP83867输出也是如此吗?
  • IOSKEW = 0.35ns 对于 TX -->对于 RX 接口上的 DP83867输出也是如此吗?
  • Tket = 0.5ns (对于 TX)-->对于 RX 接口上的 DP83867输出、这也是 rue (rue)吗?

谢谢、
Mitchell

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    您好、Mitchell、

    是的、RGMII 的发送和接收时、数据和时钟之间的偏差要求是相同的。 请参阅以下 RGMII 接口规格。

    e2e.ti.com/.../RGMIIv1_5F00_3.pdf


    配置内部延迟时、确保 MAC 或 PHY 在每个方向引入延迟。

    此致、
    GET
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    Geet、您好!

    感谢您的反馈。 我还有两点要澄清。

    当 DP83867为发送器(Rx 数据)时:

    •IDvar 时序参数是否被忽略(即、IDvar 是否包含在+/-500ps T串 中)?
    •是否忽略 IOSKEW (即、IOSKEW 是否包含在接收侧设置/保持参数中)?

    谢谢、
    Mitchell
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    您好、Mitchell、

    从发送器 IO 可以看出、IDvar 是延迟的变化。 在计算最坏情况下的设置/保持时序时、应考虑接收器与 PCB 延迟。

    IOSkew、它会说是的、这应该是接收器侧总体偏斜要求的一部分。

    此致、
    GET
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    Geet、您好!

    谢谢你。 只需再强调一点-如果 RGMII 接收(DP83867在 Rx 数据线上传输数据)的位置-并且 DP83867添加了内部延迟、我们是否需要同时考虑 IDvar 和 Tsket?

    即–内部延迟增加+/- 700ps (Tskt (500ps)+ IDvar (200ps))时、DP83867的时钟到数据偏移是否超出了?

    谢谢、
    Mitchell
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    您好、Mitchell、

    应用手册中定义的值(IDvar、IOskew 等)是示例值、有助于解释 RGMII 时序余量。

    我想、客户应专注于接收器数据和时钟引脚的设置和保持时间。 这些测量值应在 DP83867数据表中定义的 RGMII 规格范围内。



    此致、
    GET