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[参考译文] TPD4E02B04-Q1:PCIe 路径上的 ESD 应用

Guru**** 2391175 points
Other Parts Discussed in Thread: TPD4E02B04-Q1, TPD4E02B04

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/798391/tpd4e02b04-q1-esd-application-on-pcie-path

器件型号:TPD4E02B04-Q1
主题中讨论的其他器件: TPD4E02B04

您好,专家:

 如果  在 PCIe 路径上使用两个 TPD4E02B04-Q1器件、我们是否遇到了任何信号完整性问题?

此致、

Mark、  

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    标记-

    请注意布线电容-根据 PCIe 总线的速度、由于 TPD4E02B04电容的原因、可能会出现信号完整性问题。 查看这一点的最佳方法是查看器件的插入损耗图。 但是、如果不具体了解总线的速度、我就无法准确地判断。

    谢谢、

    阿尔茨

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    您好、Alec、

    这是来自 Flex Taiwan SI 团队的 Joe、
    PCIe 的速度将是第3代、
    如果在一条布线上具有两个 ESD 保护、您能建议损耗吗?

    谢谢!

    Joe
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    乔-

    看起来 PCIe 第3代每条线路具有1Gbps 的速率、因此第三谐波的带宽约为1.5Ghz。 在1.5Ghz 时、数据表图中 TPD4E02B04的插入损耗约为~μ V.25dB、因此对于两个器件、您可以预期在频率的第三次谐波处看到大约0.5dB 的损耗。

    谢谢、

    阿尔茨