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[参考译文] SN75DP159：违反 VCC/VDD 上电时序

admin
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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/841888/sn75dp159-violate-vcc-vdd-power-up-timing

器件型号：SN75DP159

尊敬的团队：

我的客户测量了 VDD 和 VCC 的加电时序。 他们发现、有时 TD1小于200us。  

原因是 LDO TLV75511PDQNR 启动时间为550us (典型值)。  

我们想知道、如果上电时序不符合此规格、会产生什么副作用？  

谢谢你。

Jim

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    您好、Jim、

    只要满足 Td2、TD1就无关紧要。 在将 OE 置为高电平之前、它们应确保 Vdd 和 Vcc 均为稳定高电平至少100us。

    此致、

    I.K.  

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    您好 I.K.

    感谢您的回复！ 如果 TD1无关紧要、我想知道我们为什么需要定义 TD1规范吗？ 非常感谢！

    此致、

    Ann Lien

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    尊敬的 Ann：

    我认为、它的定义只是为了帮助说明电源序列。 如果您看一下数据表中的表1、就会发现 TD1的最小值为0us。 这意味着允许 Vcc/Vdd 同时出现。

    但是、td2的最小值为100us、这意味着无论 Vcc/Vdd 的出现顺序如何、它们都需要在 OE 变为高电平之前保持至少100us 的稳定。   

    此致、

    I.K.  

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    尊敬的 I.K.：

    感谢您的回复：)

    此致、

    Ann Lien

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    尊敬的 I.K.：

    我认为 TD1的要求是 VCC 和 VDD 的斜升时间不应超过200us。

    但我的客户在他们的板上测量 TD1、有时超过200us。 那么、这是不允许的、我对吗？

    谢谢你。

    Jim

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    Jim

    如果 OE 较低、则 TD1无关紧要、您只需满足 Td2。  

    谢谢

    David