[参考译文] TCA9517A：输入 CLK 问题

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Other Parts Discussed in Thread: TCA9517A, TCA9617B

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/781627/tca9517a-input-clk-issue

器件型号：TCA9517A
主题中讨论的其他器件： TCA9617B

你(们)好

客户正在使用 TCA9517A 的配置、如下所示。

在这种情况下、波形如下。

输入 CLK 输入不正确。主设备侧可能存在问题。

但是、在同一配置中使用 TCA9617B 时、波形是正常的。

您知道原因吗？输入和输出上拉电阻器是否合适？

客户遇到问题、并急于找出原因。
我们需要您的支持。

此致、
石田山

6 年多前

0 admin 6 年多前

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嗨、Ishiwata-San、

主器件是否正确生成"输入 SCLA"？

在红圈期间、波形应该是低电平还是高电平？在我看来、主器件释放时钟信号、然后再次控制时钟信号。我们的 TCA9517A 不主动驱动'highs'、上拉电阻器提供高电平。如果客户不想看到上升沿、则可以将主器件时钟上的上拉电阻器更改为高于1.3k 的值。假设主器件在相同的时间差控制总线、则4K 欧姆可能会摆脱该骑边沿(使其低于 Vil)。

我唯一能想到的另一件事是从器件实际上正在执行时钟扩展。这是怎么回事？

谢谢、

-Bobby

0 admin 6 年多前

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您好、Bobby -San

"主器件生成'input SCLA'的正确吗？ "
->主器件生成 CLK。如 CPU。

"波形在红圈期间应该是低电平还是高电平？在我看来、主器件释放时钟信号、然后再次控制时钟信号。 "
->
客户希望看到应该在红圈中的 CLK。
通常、CLK 是输出、但不是输出。
客户表示在使用 TCA9517A 时钟会熄灭。

"假设主器件在相同的时间差控制总线、4K 欧姆可能会摆脱该骑边沿(使其低于 Vil)。"
->这意味着什么？更改 EN 引脚的上拉电阻？

此致、
石田山

0 admin 6 年多前

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嗨、Ishiwata-San、

感谢您了解正常运行情况。那么、看看两个波形的并排。出于某种原因、黄色的主器件将线路驱动为低电平、或者'Output SCLB2'上的从器件将线路驱动为低电平。因为我没有看到"output SCLB2"中的步骤、所以我认为问题与主器件有关。

如果我们将主器件3.3V 总线上的1.2k 上拉电阻器更改为低于800的值、可能会有所帮助。我认为这在某种程度上与代码相关、并且主器件出于某种原因认为信号的驱动速度不够快、因此决定将总线拉低。

-->这意味着什么？更改 EN 引脚的上拉电阻？"
我误解了波形应该执行的操作。请忽略我先前关于上升时间的评论。

谢谢、
-Bobby

0 admin 6 年多前

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您好、Bobby -San

感谢您的支持。

客户已验证在没有 TCA9517A 的情况下直接从 CPU 连接到从器件。
因此、类似的 CLK 可能会得到确认。事实证明、问题不是 TCA9517A。

此致、
石田山

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