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[参考译文] XIO3130:端口不工作-调试

Guru**** 2584525 points
Other Parts Discussed in Thread: XIO3130, XIO3130EVM

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1129040/xio3130-port-not-working---debug

器件型号:XIO3130

你(们)好。

客户遇到 XIO3130问题。

 

问题如下:

 

虽然器件看起来绑定正确、并且器件出现在下行端口1和2上、但客户只看到下行端口2上的活动。

如果他们扫描 PCI 总线、他们会看到器件本身、其所有下行端口以及下行端口2上的器件、但下行端口1上没有任何内容(不存在参考时钟–请参阅下面的内容)

即使下游端口3未启用、也存在参考时钟(100Mhz–见下文)

 

下面是一些更详细的信息:

 

DN1_DPSTRAP = 3.3V

GPIO[0]= 418mV (4.7K 电阻器)

GPIO[1]= 0V

GPIO[2]= 3.3V

DN1_REFCLKO:无活动

 

DN2_DPSTRAP = 3.3V

GPIO[4]= 426mV (4.7K 电阻)

GPIO[5]= 0V

GPIO[6]= 3.3V

DN2_REFCLKO:100MHz 时钟

 

DN3_DPSTRAP = 0V

GPIO[8]= 3.3V

DN3_REFCLKO:100MHz 时钟

 

 

您认为有人可以帮助解释这种行为吗? 数据表中遗漏了什么?

谢谢!

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Nicholaus、

    很抱歉、我的回答出现了延迟-考虑到我们对该问题的明显"解决办法"、我有几个问题获得了更高的优先级。

    回答您的问题:不、我仍然没有解释两个下行端口之间的行为差异。 到目前为止、我们检查 PCIe 总线上通信的所有尝试都失败了、我们只是没有设备来探测总线并查看发生了什么。

    这对我来说仍然是一个积极的问题-我只是想澄清另外几个问题,以便我能够更密切地关注这一问题。

    如果我对您有任何疑问或发表任何我认为重要的意见、我会立即告知您。

    感谢您的登记。

    此致、

    Steve

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Steve、

    好的。  感谢您的更新。   我的最新问题是询问3个电路板之间的 EEPROM 映像是否不同、这不需要 PCIe 总线、但我们可以在您返回时再次访问该映像。

    此致、

    Nicholaus