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[参考译文] TLK10232:XAUI 侧意外下行链路

Guru**** 2453130 points
Other Parts Discussed in Thread: TLK10232

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/608519/tlk10232-unexpected-link-down-at-xaui-side

器件型号:TLK10232

大家好、

我的客户面临的问题是、在 TLK10232上发出数据路径复位时 FPGA 遇到了某个时间停滞。 在我们检查 FPGA 错误状态时、似乎 FPGA 在时序上的 XAUI 线路上出现对齐错误、并且由于某种原因无法再次同步。  

根据数据表、TLK10232自动将/A/、/K/和/R/字符转换为空闲字符、并且在 XAUI 线路上持续输出"空闲"模式(数据包之间)。 我们猜测这可能是此问题的根本原因。

是否有任何寄存器可为 XAUI 通道对齐发出字符?

客户在10G KR 模式下使用 TLK10232、因此 FORCE_LM_REALREALGY 寄存器更改不起作用、因为该寄存器仅适用于10G-KX 模式。  

(我认为可以使用 PCS_RX_DEC_CTRL_CHAR、所以如果您知道该寄存器的行为、请告诉我。)

 

此致、

Takashi Onawa

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    你好,Takashi,

    客户尝试将 PCS_RX_DEC_CTRL_CHAR 设置为1b'1、以便像 RW 一样传递这些字符?

    此致、
    Luis Omar Moran
    高速接口
    SWAT 小组
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    您好、Luis - San、

    还没有。 您能否测试一下、如果可能、您办公桌上的 XAUI 输出的字符中会出现何种差异?
    此外、我想知道、在向客户告知变更之前、变更是否会产生副作用。

    此致、
    Takashi Onawa
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    您好、Luis - San、

    今天、他们尝试将 PCS_RX_DEC_CTRL_CHAR 设置为1b'1、但没有改进。

    完成数据路径重置后、是否有任何关于输出哪种数据的发现?

    此致、
    Takashi Onawa
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    你好、Takashi-San、

    您能否提供这些寄存器的值?

    CHANNEL STATUS_1
    LS_STATUS_1

    谢谢、
    Luis
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    您好、Luis - San、

    这是寄存器值。 我获取3个样本、每个样本都正常、不是同步条件。 这些值之间没有很大的差异、也没有奇怪的点。 请注意、开关导通按如下方式连接。

    此致、

    Takashi Onawa

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    这些寄存器的值是多少:

    dst_control_1

    dst_control_2

    DSR_CONTRAING_1

    DSR_CONTRAING_2

    DATA_SWITCH_STATUS

    此外、DST_PIN_SW_EN 引脚的值是多少?

    我之所以提出这一问题、是因为它似乎是一个数据开关问题。

    谢谢、

    Luis

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    您好、Luis - San、

    不使用 DST_PIN_SW_EN 引脚。
    以下是您请求的值。

    -车

    开关控制寄存器

    如下所示、仅更改了 dst_control_1
    DA:0x1E RA:0x0017 WriteData:0x2014
    其他软件设置与默认设置相同

    DATA_SWITCH_STATUS

    第二个读取值如下所示。
    4020小时
    我看到数据路径复位后、dst 和 DSR 开/关位在第一个读取值中置位。

    -通道 B

    开关控制寄存器

    仅更改了 DSR_CONTRAING_1、如下所示
    DA:0x1E RA:0x0019 WriteData:0x2518
    其他软件设置与默认设置相同

    DATA_SWITCH_STATUS
    第二个读取值如下所示。
    1080h
    我看到数据路径复位后、dst 和 DSR 开/关位在第一个读取值中置位。

    此致、

    Takashi Onawa

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    你好、Takashi-San、

    根据您之前发送的方框图、客户希望使用以下数据路径:

    通道

    LSINB => HSTXA

    通道 B

    LSOUTB <=HSRXA

    因此、它们需要按如下方式配置数据开关寄存器:

    通道
    LSINB => HSTXA

    dst_control_1
    写入0x2000
    MDIO 控制、DST_PIN_SW_EN ="0"(默认值)

    dst_control_2
    写入0x2C20 (选择副通道 LS 输入)

    通道 B
    LSOUTB<=HSRXA

    DSR_CONTRAING_1

    写入0x2500

    MDIO 控制、DST_PIN_SW_EN ="0"(默认值)

    DSR_CONTRAING_2
    写入0xCC20 (选择备用通道 HS 输入)

     

    请实施此配置、并通过寄存器 DATA_SWITCH_STATUS 告知您的结果。 顺便说一下、PRTAD0引脚的当前值是多少?

    谢谢、

    Luis

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    您好、Luis - San、

    感谢您的建议。

    如前所述、他们使用您建议的设置时遇到问题、并应用强制 SW 设置来避免此问题。

    最终、FPGA 卡住的根本原因是、在数据路径复位期间 TLK10232的 PLL 被暂时停止。 因此、我建议它们在数据路径恢复后复位 FPGA。

    上周,我们得出了这一结论,问题已经解决。

    此致、
    Takashi Onawa