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[参考译文] DS90UB928Q-Q1:有关上电序列的问题

Guru**** 2470720 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/649143/ds90ub928q-q1-question-about-power-up-sequence

器件型号:DS90UB928Q-Q1

您好、香榭丽舍

 

我的客户询问了2个有关加电序列的问题、如随附文件中所示。

 

您能回答这些问题吗?

 

此致、

e2e.ti.com/.../PowerUpReq.xlsx

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    Noboo 您好、

    对于 Q1、在所有 VDD 引脚稳定在其建议的电压范围内后、可以将 PDB 引脚变为高电平。 没有特定的 PDB 上升时间(TDLY)要求。 所有 VDD 引脚稳定至 PDB 高电平的最小延迟为0ms。

    对于 Q2、PDB 需要在硬复位之前保持高电平至少1ms。 硬复位时间(PDB 低电平时间)应至少为2ms。

    此致、
    Davor