[参考译文] UCC21520：当 VDD 打开且 HV DC-link 关闭时出现输出电压问题

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/705705/ucc21520-output-voltage-issue-when-vdd-is-on-and-hv-dc-link-is-off

器件型号：UCC21520

大家好、

我的客户在 LLC 中使用 UCC21520、他们发现当 VDD 打开但 HV 直流链路关闭时、Cin 将有大约10V 的输出电压(请参阅下图)。客户已测试 VDD=13.6V、VDDA=13.16V、VSSA=10.58V。客户不确定这是否会在 HV DC-link 接通时引起一个大问题。

问题是这怎么可能发生？ VDDA 和 VSSA 之间似乎有 P MOS 和 N MOS、它们不应同时打开。如果 VDDA 和 VSSA 之间的内部电阻器 RHI_Z 和 R_CLAMP 会产生任何影响？

谢谢。

7 年多前

0 admin 7 年多前

TI__Guru**** 2540720 points

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您好 Lucas、

我是一名应用工程师、为 UCC21520提供支持。启动期间、如果 SW 和 HV DC-Link 电压都为0V、则突出显示的静态电流路径将通过内部逻辑电路(解调器、UVLO 块、内部基准等)变为有效、直到 VDDA 至 VSSA 的电压足够小、使内部电路停用(通常约为3V)。在这种情况下、通道的默认行为是输出低电平、因此高侧 MOSFET 不应激活。在正常运行期间、此电流路径将不会处于活动状态、因为 HV DC-Link 电压将远大于 VDD、并且高侧 MOSFET 固有二极管将反向偏置。

如果它们的拓扑允许、可激活低侧 MOSFET 以将 VSSA 短接至 GND、并在启动期间防止电流流过高侧体二极管。

此致、

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