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[参考译文] DP83640:100Base-FX 模式 MDI 终端

Guru**** 2485515 points
Other Parts Discussed in Thread: DP83640, DP83620

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/679773/dp83640-100base-fx-mode-mdi-terminations

器件型号:DP83640
主题中讨论的其他器件: DP83620

大家好、

我们正在使用100BASE-FX 模式下的 DP83649 PHY 和使用 LVPECL 接口的 Broadcom/Avago HFBR-5963ALZ 进行设计。

我对 TD+/-对的正确端接有点困惑。 我知道 PHY 发送器是一个开漏输出、因此需要50欧姆的上拉电阻、并且由于 Avago 收发器是 LVPECL、我们必须使用交流耦合、然后正确偏置 LVPECL 侧。

我感到困惑的是、在 PHY 数据表中、它建议使用130ohm/82ohm 上拉/下拉终端、但在 TI scaa059c 应用手册中、当解释交流耦合 LVPECL 接口的终端时、它说需要83/130终端、因为 LVPECL 需要2V 共模电压。

哪一个是正确的?

此致、提前感谢!

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    建议您按照 PHY 数据表中的说明操作、因为它负责内部模温的其他方面

    此致、
    GET
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    Geel、

    非常感谢您的回答。 不幸的是、我认为它不能回答我的问题。

    我已经进一步研究过、我发现 Broadcom / Avago 提供的这份应用手册为他们的多个光收发器推荐了终端方案。 示例收发器包括 AFBR-5803Z。 该收发器具有 LVPECL 接口、与我们使用的接口类似、它出现在 DP86340-EVK 的原理图中。

    正如您在 Avago 应用手册中看到的、此收发器在 Tx 线路上使用交流耦合的所有示例都使用82 Ω 上拉电阻和130 Ω 下拉电阻。 这与 scaa059c TI 应用手册中的内容相同、但在 PHY 数据表和 EVK 原理图中、它们都使用了130 Ω 上拉电阻和82 Ω 上拉电阻。 因此我感到困惑。 我想您使用哪一个可能无关紧要。

    我们的设计存在一些丢包问题、因此我一直在审查整个设计过程、确保所有组件都已被正确选择、因为我们在确定问题所在的位置时遇到了问题。 这可能是另一天的帖子。

    此致。

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    您好、Francisco、

    我认为 EVM 和数据表具有错误的端接方向。 我建议您遵循 Avago LVPECL 设计的建议端接。
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    罗斯

    非常感谢。 我得出同样的结论、正确的结论可能是 Avago 建议的结论。

    此致。
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    尊敬的 Ross:

    我们非常渴望找到问题的根源、因为我们有4个单独的客户问题、而这正是我们遇到的问题。 在实验室的测试中、我们发现直流耦合为光纤收发器提供了最佳解决方案。 我们发现、与设置交流耦合电容器任一侧的 LVPECL 端接相比、将共模电压设置为大约1.25、然后再设置直流耦合、可实现更稳定的解决方案。 您能否请您的应用团队测试这些选项并为我们提供最终解决方案。 如果 TI 直接提供最佳案例建议、我们将不胜感激。

    非常感谢

    Michael

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    Michael、

    出于好奇、您是否也在使用 DP83640? 当您说您正在使用直流耦合时、您的意思是在 TD 和 RD 对中、还是仅在 RD 对中?

    希望您尽快解决问题。

    此致。
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    您好!

    我们建议在光纤收发器侧和以太网 PHY 侧进行交流耦合并建立正确的偏置。
    LVPECL 仅在与 LVPECL 收发器连接时适用。 有些收发器是 VML、CML 或 LVPECL。
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    尊敬的 Francisco:

    我们使用的是 DP83620。 我们交流耦合 TX、并在 PHY 侧上拉50欧姆电阻。 我们在不使用 LVPECL 终端的情况下对 RX 进行直流耦合、而是在1.25时使用收发器的共模来强制 PHY 的共模。 收发器具有内置的100 Ω 终端、因此我们不需要任何进一步的终端。

    此致

    Michael