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大家好、
在我们具有 AM5718的定制板中、我们使用 TPD12S016、VCCA 为1.8V。
我们发现、我们使用连接到 AM5718的 GPIO6_28的+3.3V 信号来驱动 LS_OE 输入。
LS_OE 输入以 VCCA (+1.8V)为基准、因此我们想知道这种情况是否会损坏引脚或是否可以容忍;该引脚上的绝对最大额定值为4.0V。
提前非常感谢您的支持。
Marco
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大家好、
在我们具有 AM5718的定制板中、我们使用 TPD12S016、VCCA 为1.8V。
我们发现、我们使用连接到 AM5718的 GPIO6_28的+3.3V 信号来驱动 LS_OE 输入。
LS_OE 输入以 VCCA (+1.8V)为基准、因此我们想知道这种情况是否会损坏引脚或是否可以容忍;该引脚上的绝对最大额定值为4.0V。
提前非常感谢您的支持。
Marco
你好、Chuck、
感谢您的回复和对此问题的支持。
在当前实现方案中、AM5718上的 GPIO6_28设置为输出引脚、以6mA 的最小驱动强度驱动"strong "+3.3V 和0V 电平。
为了减少流入 TPD12S016的 LS_OE 引脚的电流、我们考虑驱动逻辑"1"、将 GPIO6_28配置为具有内部上拉的输入引脚。
当启用内部弱上拉电阻时、3.3V 模式下双电压 LVCMOS 引脚的 AM5718规格报告了10uA 至290uA 的输入电流。
我们修改了 SW 以尝试此新设置、LS_OE 的驱动电压约为+3.13V;此电平仍会超出建议的规格、但最大电流限制为290uA。
考虑到 LS_OE 输入引脚规格和电平转换器架构、您认为这种新配置更可靠吗?
请告诉我们您的意见。
Marco