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[参考译文] SN65HVD1477:将 Y 输出上拉至3.3V

Guru**** 2507255 points
Other Parts Discussed in Thread: SN65HVD1477

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1270780/sn65hvd1477-pull-up-the-y-output-to-3-3v

器件型号:SN65HVD1477

您好!

我们将通过 IC SN65HVD1477D 将 BiSS-C 接口与编码器进行通信。

我们做了一个测试、将 Y 引脚(用于时钟+)拉高至3.3V 并持续1秒、但我们的系统无法检测到数据错误并继续工作。

我想问、 在 Y 引脚被上拉的情况下 Z 引脚是否可以补偿电压输出?

PS:我们还进行了一个将 Y 引脚下拉至 GND 的测试。 这次、我们可能会按预期触发系统错误。

提前感谢。

祝你一切顺利!

赵显耀

                 

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    Y 和 Z 引脚是输入。 它们仅用于从器件上的时钟信号。 但听起来您在主器件上使用 SN65HVD1477吗? 您能否展示电路原理图?

    对于 RS 至422信号的重要因素是差分电压、即 A−B 或 Y−Z。 防止差分信号通过的最可靠方法是使端接电阻器短路。

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    是的、短接端子电阻是其中一项测试。 如我们所预期的那样、端子电阻器短路可能会触发系统错误。 我提到的测试将 Y 引脚上拉至3.3V、以检查时钟线路上拉至电源电压时是否会触发系统错误状态。 看起来 Z 引脚可以补偿施加在 Y 引脚上的上拉电压。 我们使用了 Y 和 Z 进行时钟信号从微控制器传输到从器件。

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    您好、Xiyao、

    您如何上拉器件-您是通过 直接连接强制引脚为高电平-还是有电阻器将线路上拉-如果有电阻器、您可以指出其值。 系统是否也端接?  

    此致!

    帕克·道德森