尊敬的专家:
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尊敬的专家:
嘿 Krithika、
针对诸如您的偶发问题的最重要设置为寄存器0x0A、0x0B、0x10和0x12。
根据您的配置:
LVDS_CLK:62.5MHz、- 87.5 MHz
DSI_CLK = 200MHz
已使用2个通道
DSI_CLK_RANGE = 0x26
一个好的测试是尝试将 DSI 时钟增加到大约187.5 MHz、使其不处于范围间隔(5 MHz)的边缘。 这意味着您要使用的 DSI_CLK_RAGE 为185 - 190 MHz。 如果您更改此值、但保持分频器相同、输出 LVDS clcok 应为62.5MHz。 这可以使您更接近电池板的标称 DCLK、即62.58 MHz、从而可以摆脱您的零星问题。 这将使您处于 LVDS 时钟频率范围的边缘、但它更接近您理想的面板规格。
如果这不起作用、只需尝试找到 DSI_CLK 和 LVDS_CLK 的组合、该组合符合规格、并且对于任何范围寄存器都不是边沿情况。
此致!
V·皮塔迪亚