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[参考译文] TCA9539-Q1:CLK 频率和 TSCH 规格异常

Guru**** 2385400 points
Other Parts Discussed in Thread: TCA9539-Q1
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1360253/tca9539-q1-clk-freq-and-tsch-spec-abnormal

器件型号:TCA9539-Q1

大家好、

客户正在评估 TCA9539-Q1并发现输出频率异常 、高度依赖于上拉电阻器、如下所示、如果可能的原因、您可以分享吗?

当 I2C 配置为400kHz 时

I2C 上拉4.64k、测量的 CLK 频率为377.385kHz、TSCH I2C 时钟高电平时间仅为516ns、低于规格

I2C 上拉1.5k、测量的 CLK 频率为433kHz

3. I2C 上拉1k、测量的 CLK 频率为452kHz

THX

斯嘉利特

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    嘿、Scarlett、

    I2C 数据速率完全由总线上的外部上拉电阻+电容控制。 您可能会查看此应用手册、了解如何根据所需的 I2C 速度选择适当的上拉 电阻:I2C 总线上拉电阻计算

    谢谢。

    插孔  

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    您好,Jack

    该文件表示:" R 和 CB 影响了上升时间,但没有说明频率如何取决于 Rp。 您能帮助支持分析上拉/下拉对频率的影响吗?

    谢谢

    斯嘉利特

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    尊敬的 Scarlett:

    R 和 CB 的变化不应改变信号频率、而只应改变上升时间。 客户如何测量 i2c 时钟频率、我们是否有支持 O 范围屏幕截图来支持该情况?  

    我们总线上是否有 MCU 和 TCA9539-Q1之间的任何其他器件?  

    开关、缓冲器、电平转换器等?  

    此致、

    泰勒

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    I²C 主机必须监控总线信号来检测仲裁故障或时钟扩展。 当主器件想要在 SCL 上输出上升沿时、它会停止下拉线路、然后等待电压实际上升。 该等待时间取决于实际上升时间和主器件实现。

    TCA9539-Q1从不进行时钟延展、因此不会影响频率。

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    尊敬的 Scarlett:  

    关于时钟延展或多主仲裁、如果对我的问题或 Clemens 的问题有任何意见、敬请告知。  

    此致、  

    泰勒