工具与软件：
您好、TI：
如果客户将我们的芯片与 TI941+TI948一起使用、则会出现一些 ICS 抖动屏幕的具体现象：
屏幕定时：像素 clk=HPSW=1920 147.46MHz、h_act=1920、HFP=64、HBP=32、HSW=32、 V_ACT=1080、VFP=104、VBP=6、VFP=6
DSI 配置：1个时钟通道+4个数据通道、DSI 445MHz、数据速率=890MBps
1000个客户端中大约有一个或两个会抖动。 DSI 波形测量完成后发现、正常芯片在一帧内进入 LP 状态12次、异常芯片会随机进入 LP 状态
11或12次。 DSI 数据速率增加到905MBps 后、还可以正常显示异常 IC。
现在、TI 需要确认以下问题：
1： 导致以上抖动屏幕的原因是什么？
2：当 DSI 在一帧中11次或12次进入 LP 状态以进行 TI941解析时序时、有什么不同？
3： TI941对于 DSI 时序的具体要求是什么？ 例如、DSI 源屏幕的 DSI 时钟和计时有哪些具体限制？ 如何配置它以确保正常显示
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1.视频定时参数
屏幕定时：像素 clk=HPSW=1920 147.46MHz、h_act=1920、HFP=64、HBP=32、HSW=32、 V_ACT=1080、VFP=104、VBP=6、VFP=6
我注意到 VFP 重复了两次、我假设其中一个应该是 VSW？
在这些有效和消隐规格下、总水平值看起来为2048、总垂直值= 1196
在这种情况下、假设 fps 为60、那么 PCLK 应该是 2048 * 1196 * 60 = 146.96 MHz 、除非这违反了显示规格。
A： 像素 clk=HPSW=1920、h_act=1920、HFP=64、HBP=32、147.46MHz =32、 v_act=1080、vfp=104、vbp=8、vsw=8。
因此 h_total=2048、v_total=1200、147.46MHz
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2. DSI 模式
3： TI941对于 DSI 时序的具体要求是什么？
这取决于用于显示屏的 DSI 时钟配置类型、例如、有三种类型可配置为：
导致上述抖动屏幕的原因是什么？
根据使用的模式、抖动可能来自传入串行器的基准时钟、但这也可能是频率不与视频时序精确匹配的边缘情况。 请参阅下一节。
答：我们使用了 DSI 参考时钟模式(同步事件脉冲)
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3. fDSI
考虑到共享的时序参数、确定 PCLK 应更接近 146.96 MHz、除非这违反任何显示规格(在这种情况下、应更新时序参数)。
使用上面给出的公式 fPCLK =(fDSI*NLanes)/12、然后通过以下计算应确定 fDSI 的值；
(146.96)=(fDSI)*(4)/(12)
(146.96)*(3)= (fDSI)= 440.88 MHz 或881.76Mbps 的数据速率。
如果使用这两种模式、这应该是参考时钟的目标时序
答：fPCLK =(fDSI*NLanes)/12 -> fDSI=fPCLK *3
fDSI=147.46 * 3=442.38Mhz 或数据速率884.76Mbps
但884.76的速度不足以传输像素数据、因为我们 没有添加数据包报头和数据包报尾。
我查看 DS90UB941AS-Q1 DSI 启动指南(TI.com) 4.3.
如果我们 从同步事件之间进行的消隐数据包字节计数中删除了 HSS/HSE 数据包、则上述公式有效。
但在 MIPI 标准中、我找不到该请求、该请求是否仅需要 TI941？
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此处分享的信息也可在应用手册 DS90UB941AS-Q1 DSI 启动指南中找到：
DS90UB941AS-Q1 DSI 启动指南(TI.com)
2：当 DSI 在一帧中11次或12次进入 LP 状态以进行 TI941解析时序时、有什么不同？
根据 MIPI 标准、DSI 源应进入空闲模式(LP-11)或保持在 HS 模式(LP-00)下、并在这些时间内传输消隐。 源代码必须严格遵循此标准并在视频帧的至少一个 BLLP 周期内进入 LP-11、您能否进一步描述在正常和异常之间记录的 LP 状态11或12？
此外、提高频率是否可以完全消除任何抖动？ 这似乎与使用的其他配置不匹配。
A： DS90UB941AS-Q1 DSI 启动指南(TI.com) 4.3.
由于我们的 DSI 数据速率为890MBps、因此我们将在 BLLP-4中进入 LP11、这是否会导致 HFP 大于预期？
这意味着在传输数据帧(每个行数据不返回到 LP11)时、我们必须确保处于 HS 模式。 是否仅在垂直消隐区域、BLLP-2恢复为 LP11？
