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[参考译文] SN65DPHY440SS:SN65DPHY440SS:

Guru**** 1794070 points
Other Parts Discussed in Thread: SN65DPHY440SS
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1415904/sn65dphy440ss-sn65dphy440ss

器件型号:SN65DPHY440SS

工具与软件:

我们目前正在开发 PTZ 摄像头监控系统、并使用 SN65DPHY440SSRHR 重定时器来延长 MIPI HS 信号长度。

当前问题是:我们遇到了随机的瞬时卡住问题。

MIPI 总长度约为650米、信号通过各种电路板从摄像头传输到处理器、请参阅下图。

我们还观察到、眼图在 MIPI 重定时器 IC 之前和之后都出现故障。 您能否介绍重定时器 IC、并就我们为了更好地调优 MIPI 信号而可以实施的潜在变化提供指导? 我们已采用 MIPI 重定时器的默认硬件配置进行了测试。

重定时器之前(CLK、D0)

另外、还观察到重定时器之后的 MIPI 时钟数据速率从原来的890Mbps 变为1.9Mbps。

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    嘿、Vishal、

    方框图中进行了哪些眼图测量?

    我们通常不会看到靠近650m 的应用、这是一个拼写错误吗? 如果应用是650m 的插入损耗会在眼图中起很大的作用、因此我想确认这些测量是在哪里进行的。

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    您好、Vishesh

    正如我在图像中所提到的、第一个图像是在 MIPI 重定时器板之前获取的、第二个波形是在 MIPI 重定时器板之后获取的

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    该器件的当前设置是什么? (控制引脚设置为什么/ I2C 设置是什么)

    - EQ 是否已最大化?

    -您是否有可以提供的示意图?

    正如我在图本身所提到的、第一张图像是在 MIPI 重定时器板之前拍摄的、次要波形是在 MIPI 重定时器板之后采集的

    很抱歉我在原始帖子中错过了该内容。 以便更好地澄清我的问题。 TX 和 RX 迹线是什么样子的/ DPHY440SS 必须对电路板上的插入损耗进行补偿?

    [报价 userid="6236906" url="~/support/interface-group/interface/f/interface-forum/1415904/sn65dphy440ss-sn65dphy440ss 并且、观察到重定时器之后的 MIPI 时钟数据速率正从最初的890Mbps 变为1.9Mbps。

    数据速率是时钟速率的2倍、因此数据通道的最大数据速率为1.5Gbps、但最大时钟速度为750MHz。

    如果时钟速度超过750MHz、则 PLL 无法正确锁定到信号。

    时钟信号的频率是多少?

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    [报价 userid="6236906" url="~/support/interface-group/interface/f/interface-forum/1415904/sn65dphy440ss-sn65dphy440ss 并且、观察到重定时器之后的 MIPI 时钟数据速率正从最初的890Mbps 变为1.9Mbps。

    这很可能是由于眼睛不当而从示波器角度来看出现的误差。 两幅图像上的差分信号周期大致相同:

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    尊敬的 Vishesh:

    使用直接焊接在 MIPI 引脚上的差分探头对其进行了测试、我可以看到眼图之间的主要差异。 另外、重定时器后的掩码建议设置也失败。

    [报价 userid="574220" url="~/support/interface-group/interface/f/interface-forum/1415904/sn65dphy440ss-sn65dphy440ss/5426751 #5426751"]

    该器件的当前设置是什么? (控制引脚设置为什么/ I2C 设置是什么)

    [报价]

    目前、我们正在使用 R&S 16GHz 示波器及其差分探头、用于两个 MIPI 组(系统中的两个摄像头)的 MIPI 891Mbps 速度、因此它未超出重定时器的限制。
    此外、我们正在使用重定时器的默认硬件设置、与其他尝试使用的多重定时器配置相比、此设置可获得更好的结果、请找到原理图。



    [报价 userid="574220" url="~/support/interface-group/interface/f/interface-forum/1415904/sn65dphy440ss-sn65dphy440ss/5426751 #5426751"]

    - EQ 是否已最大化?

    [报价]

    我们需要进行哪些设置? 由于 SCL 引脚、当前它在硬件侧被上拉。

    [报价 userid="574220" url="~/support/interface-group/interface/f/interface-forum/1415904/sn65dphy440ss-sn65dphy440ss/5426751 #5426751"]

    -您是否有可以提供的示意图?

    [报价]

    提供了上面的图像

    时钟信号的频率是多少?

    两个摄像头89Mbps、即445MHz 时钟、

    此外、根据先前文章中的共享方框图、当前重定时器放置在中间、重定时器到处理器板的距离约为400mm、重定时器到处理器板的距离将超过350mm。 因此、请根据接收到的这一波形分享最佳的寄存器配置设置。  

    由于这一原因、我们陷入了该项目的困境、您的迅速响应对解决方案表示高度赞赏。

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    嗨、Nilav、

    您是否还能够发送板的布局。 我想了解是什么导致了眼部不良。 我以前没有见过这样的东西。  

    我不确定您所指的默认设置是什么。 当摆幅调节和预加重被拉高和拉低时、会为原理图中的这两个值创建一个浮点。  

    建议对 电压摆幅、HS 预加重和 LPTX 边沿速率控制使用以下设置。

    从原理图的外观中可以看出、您使用 I2C 控制器件。  

    我建议测试 EQ 对信号的影响。 您是否能够使用0dB 和5dB EQ 捕捉波形?

    电路板设计中使用的布线的宽度是多少。 我们建议使用10密耳的宽度

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    尊敬的 Vishesh :

    我无法发送布局、因为它是客户专有的、但让我向您分享有关布局路由的更多详细信息、
    当前、MIPI 信号通过摄像头+ MCU +重定时器+ CCB 板路由、并通过50 Ω 同轴电缆。
    另外、我们还使用滑环(机械部件、机械布置的两侧都有26AWG 特氟龙电缆)
    摄像头板: (以黄色突出显示) 85Ohm (L1/L3:5.2/4.5mil)

    MCU 布局:(以黄色突出显示) 85 Ω(L1/L3:5.5/5.5mil)


    重定时器电路板:(以黄色突出显示) 85 Ω(L1/L3:5.5/5.5mil)

    好的、我们将使用 您的共享 设置进行电压摆幅、HS 预加重和 LPTX 边沿速率控制测试。

    我们已经测试了具有0和5dB 的 EQ、并在两种情况下都观察到卡住 、而 在从 0 dB 到5dB 的大变化中没有观察到。 此时应该是怎样的其他寄存器设置。

    PS:默认重定时器配置意味着固件中没有寄存器设置。

    请建议最好的配置来解决流媒体卡住的问题、因为我们在项目中因该问题而陷入困境。

    谢谢、此致、
    Nilav Choksi

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    嗨、Nilav、

    我想看看会导致器件眼图如此差的原因。 这似乎不仅仅是一个预加重配置问题的 EQ。 所示的迹线比建议的要薄、这会影响插入损耗、但在445MHz 处、这不会对眼图产生影响。 您是否遵循从 LP11状态到 HS 状态的正确转换?

    尝试使用以下命令将通道0设置为 HS 状态、然后查看这是否可以改善通道0的眼图:

    仅为通道0启用 HS 路径:

    为 HS TX 路径写入寄存器0x50、启用8'h01 //覆盖

    在启用8'h01 //HS TX 路径的情况下写入寄存器0x51。

    将8'h00 //禁用 LP 路径写入寄存器0x61。

     为 HS RX 路径写入寄存器0x70、启用8'h01 //覆盖

    在寄存器0x71中写入8'h01 // HS RX 路径启用。

    如果这可以改善眼图。 我将与设计人员交谈、看看我是否能够获得强制所有通道进入 HS 模式的命令。  

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    尊敬的 Vishesh:  

    我们尝试了如下为 HS 路径提供的配置、但在更新这些寄存器后、我们无法获得摄像头流、并且流被停止。

    为 HS TX 路径写入寄存器0x50、启用8'h01 //覆盖

    在启用8'h01 //HS TX 路径的情况下写入寄存器0x51。

    将8'h00 //禁用 LP 路径写入寄存器0x61。

     为 HS RX 路径写入寄存器0x70、启用8'h01 //覆盖

    在寄存器0x71中写入8'h01 // HS RX 路径启用。

    写入上述所有寄存器后、我们将再次读取寄存器、从而在0x51和0x71寄存器上获得一些不同的值。  

    写入上述寄存器后读取值:  

    在寄存器0x51上、我们将获得0x11值。

    在寄存器0x71上、我们将获得0x1F 值

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    尊敬的埃菲尔铁塔:

    您是在有数据传入时写入这些寄存器值、还是在传输数据之前配置器件?

    在这种情况下、强制进入 HS 状态意味着 IS 器件将无法通过 LP 信令。 需要使用此 LP 信号来将 MIPI 源的发送器设置为 HS 状态。 如果我们在 MIPI 源未配置为 HS 状态之前将器件更改为 HS 状态、这可能会导致击穿。 如果尚未完成此操作、请尝试更改此寄存器值、因为 HS 数据正在通过通道发送。  

    此外、您能否验证 MUCU 板上的 MIPI 线路和重定时器板之间是否执行了正确的步骤 以将重定时器置于 HS 模式?

    多个电路板和器件上是否也会发生这种情况? 您是否尝试过与器件交换 ABA?

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    重定时器连接到 MCU、而摄像头流式传输由处理器处理。 由于 MCU 不知道流式传输何时开始、因此我们无法在每次流式传输开始或结束时配置重定时器。 相反、我们将在 MCU 复位期间仅配置重定时器一次。

    此外、我不确定为什么需要手动设置 HS 模式。 数据表中未提及这一点、并且您共享的寄存器设置似乎也未在其中记录。 根据我的理解、这应该由 IC 自动处理、只有 EQ 和电压设置需要手动配置。

    另一项更新:当我们用电缆更换滑环时、即使没有配置 HS 线寄存器、MIPI 线也显示正确的眼图。

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    嗨、埃菲尔、

    这是一个好消息! 您正在使用的滑环与传统电缆有何区别?  

    我们可能需要将信道设置为 HS 模式的原因是、信道0也用于使用 DSI 协议的 BAC 通信。  

    在不需要这种反向通信(CSI 接口)的情况下、有时强制该通道处于 HS 模式是有利的。 当 MIPI 拉电流和灌电流之间放置一个处理器时、该处理器可能无法正确发送 LP 信号来配置 SN65DPHY440SS。  

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    Vishesh、您好!

    我们刚刚绕过滑环机制并使用直接电缆进行连接。

    但我们仍然需要配置重定时器、以检查具有滑环的不同眼图。

    在我们的设置中、微控制器与重定时器连接、它独立于 MIPI 线路、而且永远不知道数据何时发送和接收。

    无论您建议寄存器的 HS 模式配置、数据表中均未提及。  

    您能帮助配置数据表中的寄存器吗?  

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    嗨、埃菲尔、

    我提供的这些寄存器用于绕过内部自动配置,这不在数据表中,因为这是绕过我们的一些内部逻辑块,不建议.

    似乎 DPHY440SS 配置正确、但在使用滑块时看到奇数端接。

    您是否能够使用 TDR 来测试滑块的阻抗?

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    您好!

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