[参考译文] SN65LVDS179：驱动器和差动接收器的信号转换时间

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1460676/sn65lvds179-signal-transition-times-for-driver-and-differential-receiver

器件型号：SN65LVDS179

工具与软件：

您好！

我的客户注意到、测试电路图(图12)提到了1ns 的上升和下降时间、并询问驱动器的输入(D)或差分输入(A 和 B)是否有任何上升和下降时间要求。我找不到 D 引脚上提到施密特触发输入的任何信息、但我不知道建议的最短时间是多少。此外、由于器件在接收器上具有失效防护(针对悬空或高阻抗情况)、我怀疑接收器有任何转换时间要求。您能帮助提供有关最佳回应方式的建议吗？

我直觉的反应是将输入转换时间保持在标准 CMOS 输入<CMOS 上1µs、但一些数据表实际上指定了这一点。我在这个数据表中没有看到它。我们是否有建议？

John

10 个月前

0 admin 10 个月前

TI__Guru**** 2468610 points

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尊敬的 John：

如您所述、该器件没有输入上升/下降时间要求。在 SN65LVDS179上、使用了1ns 的上升时间和下降时间来获取数据表的开关规格。据我所知、我们没有具体的最低建议。但是、本应用手册中详细介绍了- 了解施密特触发(修订版 A) 最好在没有施密特触发输入的器件上考虑此问题。

谢谢您、Amy

0 admin 10 个月前

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简单来说、是驱动器输入引脚、D 引脚还是施密特触发输入？我猜不是,不是,但我想确认

谢谢！

John

0 admin 9 个月前

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尊敬的 John：

很抱歉响应延迟。 Amy 已经离开 TI、所以她无法给您回复。

xiang gao1 说：
驱动器输入引脚、D 引脚、施密特触发输入是否是？我猜不是、不是、但我想确认

否、D 输入端没有施密特触发。此器件输入的基本图实际上位于数据表的首页上。设计人员通常使用这些具有一定重叠 Vth 的 CMOS 输入结构来创建伪迟滞。通常处于100mV 的低范围。

-鲍比

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