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[参考译文] DS90UB914A-Q1:锁定时间

Guru**** 2468460 points
Other Parts Discussed in Thread: DS90UB914A-Q1

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1466979/ds90ub914a-q1-lock-time

器件型号:DS90UB914A-Q1

工具与软件:

大家好!


我对 DS90UB914A-Q1上的锁定有疑问。

如下面的数据表所述、在12位低频模式下、PCLK 在 LOCK 信号变为高电平之前变为有效。

(1)请告诉我在 PCLK 变为有效后、LOCK 信号变为高电平需要多长时间。

(2)我是否正确理解了在 LOCK 信号变为高电平之前由解串器 IC 生成的 PCLK 信号已最终确定?

此致、
Ishiwata

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    您好、Ishiwata-San、

    我们没有 LOCK 和 PCLK 之间的时间规格、但 总解串器锁定时间范围为15ms 至22ms。 在12位 HF 模式下运行时、LOCK 信号连接到串行器以接收有效的 PCLK、其他模式没有这种依赖性。 另请注意、这些器件不会修改任何输入数据、而只是直接输出接收到的串行器数据不变。

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    您好、Darrsh-San、


    感谢您的回答。

    假设解串器的总锁定时间为15-22ms。

    15-22ms 的起始点是什么? 是从 PCLK 被识别到锁定的时间吗?

    此外、在12位 HF 模式下运行时、LOCK 信号取决于有效串行器的 PCLK、但在其他模式(如 HL 模式)中、串行器的 PCLK 直接通过解串器输出、无论锁定情况如何。

    这种理解是否正确?

    此致、
    Ishiwata

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    您好、Ishiwata-San、

    总锁定时间 是器件 PDB 变为高电平与锁定之间的时间。 是的、该器件能够在锁定稳定之前输出 PCLK。 这涉及到器件的启动以及每个信号何时变为高电平。  

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    您好、Darrsh-San、


    感谢您的答复和支持。

    我想澄清一下内容。 我对以下内容的理解是否正确?

    -当在12位 HF 模式下操作时,在锁定信号生效之前输出 PCLK 信号,但在锁定信号生效之前不能获得稳定的 PCLK 信号(正确的 PCLK 信号)。
    -在12位低频模式和10位模式中,锁定信号和 PCLK 信号之间没有相关性。 因此、在启用锁定信号之前、会获得稳定的 PCLK。


    此致、
    Ishiwata

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    您好、Ishiwata-San、

    在12位 LF 和10位模式下、PCLK 信号将在锁定前输出。 对于12位 HF、PCLK 信号将与 LOCK 输出同时。 在这两种情况下、输出信号都是稳定的、只有与锁定信号相关的时序是不同的。

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    您好、Darrsh-San、

    感谢您的回答。

    在12位 LF 模式和10位模式下、我是否能够理解、如果锁定信号有效、则输出稳定的 PCLK 信号?

    此外、我是否能够理解、无论锁定信号如何、输出 PCLK 信号都是稳定的 PCLK 信号?

    此致、
    Ishiwata

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    您好、Ishiwata-San、

    是的、但 我需要指出、这是假设系统的其余部分按预期运行的。 例如、如果提供数据的摄像头/成像仪没有发送有效的 PCLK、则解串器将不会校正 PCLK 信号。

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    您好、Darrsh-San、


    感谢您的回答。

    很抱歉、我的问题问得不好。

    您的回答"是"是指哪一个?

    ・在12位 LF 模式和10位模式下、我能否理解如果 Lock 信号有效、则输出稳定的 PCLK 信号?
    ・无论锁定信号如何、输出 PCLK 信号都是稳定的 PCLK 信号?


    此致、
    Ishiwata

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    您好、Ishiwata-San、

    在12位 LF 模式和10位模式下、在将锁定信号置为有效之前、稳定的 PCLK 将变为可用。 在12位 HF 模式下、当锁定信号有效时、稳定的 PCLK 将变为可用。

    无论使用何种模式、器件都仅输出串行器接收到的 PCLK 信号。 器件不会生成新的或修改后的 PCLK 信号。