工具与软件:
大家好!
我对 DS90UB914A-Q1上的锁定有疑问。
如下面的数据表所述、在12位低频模式下、PCLK 在 LOCK 信号变为高电平之前变为有效。 
(1)请告诉我在 PCLK 变为有效后、LOCK 信号变为高电平需要多长时间。
(2)我是否正确理解了在 LOCK 信号变为高电平之前由解串器 IC 生成的 PCLK 信号已最终确定?
此致、
Ishiwata
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工具与软件:
大家好!
我对 DS90UB914A-Q1上的锁定有疑问。
如下面的数据表所述、在12位低频模式下、PCLK 在 LOCK 信号变为高电平之前变为有效。 
(1)请告诉我在 PCLK 变为有效后、LOCK 信号变为高电平需要多长时间。
(2)我是否正确理解了在 LOCK 信号变为高电平之前由解串器 IC 生成的 PCLK 信号已最终确定?
此致、
Ishiwata
您好、Darrsh-San、
感谢您的回答。
假设解串器的总锁定时间为15-22ms。
15-22ms 的起始点是什么? 是从 PCLK 被识别到锁定的时间吗?
此外、在12位 HF 模式下运行时、LOCK 信号取决于有效串行器的 PCLK、但在其他模式(如 HL 模式)中、串行器的 PCLK 直接通过解串器输出、无论锁定情况如何。
这种理解是否正确?
此致、
Ishiwata
您好、Darrsh-San、
感谢您的答复和支持。
我想澄清一下内容。 我对以下内容的理解是否正确?
-当在12位 HF 模式下操作时,在锁定信号生效之前输出 PCLK 信号,但在锁定信号生效之前不能获得稳定的 PCLK 信号(正确的 PCLK 信号)。
-在12位低频模式和10位模式中,锁定信号和 PCLK 信号之间没有相关性。 因此、在启用锁定信号之前、会获得稳定的 PCLK。
此致、
Ishiwata