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[参考译文] ISOS141-SEP:未使用的引脚

Guru**** 1133960 points
Other Parts Discussed in Thread: ISOS141-SEP
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/isolation-group/isolation/f/isolation-forum/1252942/isos141-sep-unused-pins

器件型号:ISOS141-SEP

在我的应用中、我不需要使用 ISOS141-SEP 的某些通道。  对于未使用的通道、我应该如何连接未使用的 I/O 引脚(保持开路、拉低、拉高等)?

谢谢!

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    您好!  

    感谢您的提问!

    对于一个应用、将未使用的引脚保持 为悬空会导致器件的抗噪能力下降。 为了消除噪声、您可以将通道输入设置为其各自的默认状态。

    由于 ISO141-SEP (非 F 版本)默认输出为高电平、因此必须使用拉高电平(连接到 VCC)来提高器件的抗噪能力。

    有关更多详细信息、请参阅以下常见问题解答: e2e.ti.com/.../faq-can-unused-channel-pins-on-a-digital-isolator-be-left-floating

    此致、

    A·维塔尔

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    您好!

    将下拉电阻(10千欧)或(0欧姆)接地、而不是为 未使用的引脚使用 ISO141-SEP (非 F 版本)的上拉电阻、会有什么影响? 输出保持开路。

    这是否会影响 IC 的行为?  

    谢谢!

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    您好!  

    感谢您的提问!

    我在下面回答了您的问题:

    1. 将下拉电阻(10千欧)或(0欧姆)接地、而不是为 未使用的引脚使用 ISO141-SEP (非 F 版本)的上拉电阻、会有什么影响? 输出保持开路。
      1. 与10k Ω 下拉电阻相比、0欧姆下拉电阻的电流消耗更大。
    2. 这是否会影响 IC 的行为?
      1. 使用10k Ω 或0 Ω 下拉电阻不会影响器件的行为。

    此致、

    A·维塔尔