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[参考译文] CD4070B:Vil、max 定义

Guru**** 2348430 points
Other Parts Discussed in Thread: CD4070B
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1504694/cd4070b-vil-max-define

器件型号:CD4070B

工具/软件:

团队、

客户目前正在使用 CD4070B 进行逻辑设计、来设计 MD 的位置旋转变压器系统。

1.在下面的电路中、4070的 U 引脚最初设置为2.5V。 U 设置为2.496V。 在这种情况下、输入条件会下降到未定义的区域(VIL、max = 1.5V、如 d/s 中所定义)。 在此状态下、4070的输出通过4.7k 上拉电阻被3.3V 拉高、如所示电路。  

此外、当 U 和 U-引脚4070设置为1V 时、IC 会符合定义为 VIL、max < 1.5V、max 的规格 4070被拉至低电平状态。  

 我们只想确认上述各项是否正确?

此致

Brian

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    对于  VIL (max) 和 VIH (min)之间的任何输入电压、输入的状态是未知的、即、它可能是高电平、低电平、或振荡。 因此相应的输出也将为高电平、低电平或振荡;它不会处于非活动状态。

    此外、您还会产生击穿电流、可能会损坏器件;请参阅 [常见问题解答]慢速或浮点输入如何影响 CMOS 器件?

    这些 U/U−电压的含义是什么? 您尝试解决的实际问题是什么?

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    谢谢。

    对于原理图中的 U/U-电压、RD 仅描述了 CD4070的输入引脚电压是如何设置的、只是想知道它们发现的行为是否正确? 只需与您确认即可。 谢谢。  

    此致

    Brian

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    在未定义区域中,输出的行为未定义(但它将驱动高电平或低电平)。