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[参考译文] CD14538B:咨询 CD14538输入信号发生变化时的输出信号情况

Guru**** 2341440 points
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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1524265/cd14538b-consultation-on-the-output-signal-situation-when-the-input-signal-of-cd14538-changes

部件号:CD14538B

工具/软件:

T=R1*C1  

图1中 Q 引脚输出信号的高电平时间是多久?

当输入信号的周期大于 T(T=R1*C1 )时、计算输出信号 Q 高电平时间的公式是什么?

当输入信号的周期小于 T 时、输出信号 Q 是否始终保持高电平?

                 图1.

谢谢

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    触发仅在单信号的下降沿发生。

    该器件是可重触发的、也就是说、每个下降沿将使输出脉冲延长一个周期;请参阅数据表第2页的底部。

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    图1中 T 的计算结果是否为 Q 端子上高电平输出脉冲的时间宽度?

    T=R1*C1=0.47s。


    谢谢!  

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    尊敬的 Liujun:

    是的、这应该是常规计算。 不过、还涉及"K"系数(通常接近1)、但数据表提供了一些变化图表。  

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    谢谢!