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[参考译文] SN74LVTH16244A:缓冲器输出端的偏移量

Guru**** 2805935 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1603416/sn74lvth16244a-offset-at-buffer-output

器件型号: SN74LVTH16244A

大家好、我在电路板中使用了 SN74LVTH16244ADL 缓冲器。 此缓冲器用于外部连接器和 FPGA 之间。 结果表明、该缓冲器的一个特定输出的输出 (3Y1) 失调电压为 1V。  

所有输出均通过直接连接 Artix 7 FPGA、所有信号均采用相同的设计方案。

在不同的电路板上也出现了相同的问题。 帮助我尽快解决此问题。

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    尊敬的 Athulijth:

    能否确保“COMMON_BURE_INPUT_FPGA_24"实际上“实际上配置为 FPGA 上的输入、而不是输出? 您的 FPGA 可能会引入总线争用、并在缓冲器将此信号驱动为低电平时尝试将其驱动为高电平、反之亦然。

    此致、

    Malcolm

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    我们在开始阶段本身进行了这项检查、并确保所有“COMMON_BURE_INPUT_FPGA_"信号“信号都被 定义为输入。 我们检查了 4 块电路板、在这 2 块电路板中、我们观察到了这个情况。  

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    尊敬的 Athulijth:

    您是否在两个正常工作的电路板和两个具有观察结果的电路板之间进行了 ABA 交换?

    此致、

    Malcolm

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    否、我将其替换为新的 IC 和缓冲器输出端创建的偏移量(“COMMON_BURE_INPUT_FPGA_24 已消失。

    使用同一个电路板还可以观察到一个问题。  

    COMMON_BUF_25、在输入端馈送 2.9V 后、对于这个特定线路、观察到输入为 1.5V、但对于所有其他输入、输入约为 1.62V。 而缓冲器的输出不是“25"。“。  

    以下是输入方案、所有常见中断输入都是相同的。

    这一观察结果发生在 1/4 的电路板上。 即使在更改缓冲区后、观察结果也是相同的。

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    你好、阿苏尔吉思、

    问题可能是您在输入端具有 10nF 电容器。 请注意以下器件的输入上升和下降时间要求:

    使用 1k 欧姆和 10nF 的低通滤波器值、您可以预计输入的压摆率约为 0.1V/us、与 10,000ns/V 的反向压摆率相关 这比 10ns/V 或更快的要求慢得多。

    当输入信号速度很慢时、您可能会在信号转换期间损坏输入缓冲器、输出缓冲器或整个器件、因为它们可能会受到重复的振荡的影响。

    此外、为什么针对所有输入为此器件提供 1.51.62V 的输入? 输入电平高电压为 2V。 要么低通滤波器的缓慢上升时间会对每个输入级造成一定程度的损坏、要么损坏的输入缓冲级会阻止输入完全上升到 3.3V、要么您电路板上的某些电阻分压器或其他元件会导致您明确无法满足该器件的正确输入电压电平要求。

    1.5V 至 1.62V 正好在该器件的输入转换阈值附近 (3.3V VCC)、如果输入电压保持在该电平、您可以预计输出将在 3.3V 和 GND 之间振荡、而不是按照数据表的要求上升到 2V 以上。

    此致、

    Malcolm