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[参考译文] SN74HC165：故障取决于上升时钟信号

admin
Guru**** 2422790 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/601526/sn74hc165-malfunction-depending-on-rise-time-clock-signal

部件号：SN74HC165

您好，

  SN74HC165PW在 Vcc=5V的情况下出现故障，1kHz的时钟信号和Vcc的50 % 上升时间约为80µs。

Vcc的Rise Time to 50 % 约为9µs μ m，工作正常。

 是否对上升时间有任何要求，或者您是否看到了另一个根本原因？

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    TI__Guru**** 2422790 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    允许的输入上升时间在数据表的6.3 部分中指定。 3.2万 ns/V的速度有点慢。

    如果无法更改时钟源，请添加施密特触发器缓冲区。
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    TI__Guru**** 2422790 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好，Martin，

    数据表的推荐工作条件表中列出了输入计时要求规范。  如果Vcc为5V，则每伏电压不应超过500ns (即50 % Vcc为2.5us，完全上升时间为5us)。

    CMOS输入对慢速边缘非常敏感，可能会产生内部振荡，过大电流和不稳定行为。  我们有一份关于此主题的应用报告，阅读内容非常有趣：