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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1101026/sn74avc16t245-b-port-pull-hign-behavior-when-the-vccb-is-powered-on
大家好，
客户报告了一个问题，希望与您核实这是否属于正常行为：
在VCCB通电期间，B端口信号(标在红色方块中)先拉高，然后拉低。
您好Fanbin，
是的，由于内部竞争条件和随电源增加而出现的浮动节点，可能会出现通电小故障。 如果这是客户系统的问题，我建议使用两个SN74AXC8T245设备-这些设备具有故障抑制电路以消除这些故障。
您好，Dylan，
感谢您的回复！
1.首先，客户想要了解 有关内部竞争状况和浮节点的更多详细信息，您能否提供详细原因说明故障是如何发生的？
2.我认为在上拉电源和IO输出之间的时间序列出现胶片问题。
当前设置为OE和Porta已就绪， 端口B用作输出，VCCB开始上升。当VCCB未启用时，端口B IO是高脱模状态，当存在IO上拉电压时， IO电压开始上升一点，当VCCB完全建立且IC开始正常工作时，端口B变为逻辑低(输入A端口低)
这是否是此案例的正确解释？ 如果是， SN74AXC8T245是否可以用于解决此问题？
由于最初提供的信息有限，所以很难看到所有这些，但这是一个合理的解释。 如果VCCB为0V，则VCC隔离/Ioff电路将使I/O进入Hi-z状态，并且如果有一个上拉电路连接到该电路，则会将其上拉。 一旦B端口供应充足并设置为输出，如果A输入为低，则它可以拉低线路。
我提到的故障是指两个耗材通常同时增加的情况。 控制电路可能会在某种意义上混淆，从而导致I/O出现故障 使用SN74AXC8T245可以消除这种情况，但上述情况仍会发生在该设备上。
谢谢Dylan，
是否有任何可能的解决方案来避免 上述情况
因为对于客户的系统，下游负载不能接受这种情况
他们不能只是把上拉或把它切换到下拉？
对不起，Dylan，
您能不能更清楚地描述一下？ 我不确定我们如何建议客户更改他们的设计。
你能在我给你展示的照片上标记它吗？ 或者，我们是否需要其他信息来帮助更好地找到根本原因？
Fanbin，
您提到了正在上拉的I/O，我可以看到原理图中有上拉。 因此，如果他们不希望他们拉电压，他们可以将其拆下，或者让他们下拉，以查看是否可以解决问题。
如果他们卸下上拉， IO驱动程序是否足够强大？
我们的IO内部结构是什么，我们在当前设计中是否需要额外的提升？
上拉的确切目的是什么？ 听起来比其他任何问题都更容易导致系统问题。 此译员不需要上拉即可实现高。
