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[参考译文] TXS02612：TXS02612原理图问题

admin
Guru**** 2416110 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1031518/txs02612-txs02612-schematic-questions

器件型号：TXS02612

您好！

我尝试做一些可能不太寻常的事情；我计划对 SD 卡进行多路复用、但在两个系统之间共享访问、一个系统一次只能看到一个 SD 卡。

为此、我使用了两 个 TXS02612R 多路复用器、其中只有一个器件控制哪个器件访问哪个卡。 第三个模拟多路复用器控制对电源和检测线路的访问(原理图如下)。  在进入该部件之前、我已经成功地通过普通模拟多路复用器实现了相同的目标。

这种方法是否适用于该特定部件？

 TXS02612R 内部上拉电阻是否不需要上拉电阻器？

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    TI__Guru**** 2416110 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    嗨、Craig、

    这不是该器件的预期应用、可能会出现一些问题。 连接两个不同 TXS 器件的 I/O 会增加边沿速率加速电路总线争用的风险。 您还可能会看到一些直流电平问题。  要了解这是否适用于您的系统、我建议进行原型设计。

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    TI__Guru**** 2416110 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    迪伦、您好、感谢您的回复。

    我假设您参考的是数据表第4页上的注释... 

    R1 and R2 resistor values are determined based upon the logic level applied to the A port or B port, as follows:
R1 and R2 = 40 kΩ when a logic level low is applied to the A port or B port.
R1 and R2 = 4 kΩ when a logic level high is applied to the A port or B port.
R1 and R2 = 70 kΩ when the port is deselected.

    这是否意味着当 Mux1上的端口被取消选择时、未激活的 IO 将在它们上有一个70k 上拉电阻器？

    是否存在这会干扰 MUx2活动端口上的上拉电阻的问题？ 这将如何导致直流电平问题？

    谢谢、
    Craig

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    TI__Guru**** 2416110 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    嗨、Craig、

    我所指的直流电平问题来自导通 FET 的上拉电阻和 Rdson。 驱动 TXS 器件 I/O 的任何器件都必须有效地吸收(该通道上)上拉电阻的所有电流。 除此之外，任何流经导通 FET 的电流都将导致电压偏移(VOL = VIL + iPass*Rpass)。  

    我希望 I/O 负载的电容也相当大、因此不建议这样做、因为这会对单次电流产生负面影响。