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[参考译文] SN74HC595:技术问题

Guru**** 1753810 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1036957/sn74hc595-technical-issues

器件型号:SN74HC595

大家好、

在 RCLK 0-1之前、我有一个左移 QA-QH 问题(在 RCLK 1-1和7位输入 SRSCL 后设置、SER 已接收)在 RCLK 0-1之后、QA-QH 正常、但它在每个 RCLK 的移位和右态之间波动。  
我该如何避免在0-1 RCLK 之前发生"基地"组织- QH 转移?

非常感谢你的帮助。

此致、

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    您好!

    恐怕我不理解这个问题。

    您能否提供设计原理图和显示问题的示波器截图?

    如果您无法获得示波器截图、任何显示时序和信号的图都有助于解释问题。

    "在每个 RCLK 上的偏移和右状态之间波动"是什么意思?

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    您好、Maier、

    感谢你的帮助。

    这是 QA-QH 图、结果错误。


    正确的设置。


    输入大致相同(某些时序和电路板不同)。


    RCLK 仅为一个0-1、但在7位和8位.1-SR 行 QH 后有两个 qn。

    此致、

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    您能否告诉我们您在这些图像中捕获了哪些输入和输出信号?

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    大家好、

    第1排 QH 引脚7
    2 - Qg 引脚6
    3 - QF
    4 - QE
    5 - QD
    6 - QC
    7 - qb 引脚1
    8 - RCLK 引脚12

    谢谢。

    此致、

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    这些图像只有7行。

    看到 RCLK、SRCLK 和 SER 会有所帮助。

    我怀疑 违反了设置/保持时间;请放大足够远、以便可以检查这些时间。

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    大家好、Clemens、

    感谢你的帮助。

    最新的图有8个信号、底部是 RCLK。 时序以 us 为单位、最小 SER 0-0为1us、1-1高于10us。 我的问题是在 RCLK 为高电平或为1时存储数据的原因、因此当 RCLK 1-1和0-1时、它会存储两次数据、而不仅仅是在上升沿前侧或0-1上。

    SRCLK 0-0 min 为1us、1-1高于10us。

    RCLK 0-0大约为250us

    VCC 约为4.9V

    此致、

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    输出只能在 RCLK 的上升沿发生变化。 您的电路中可能存在噪声。 请显示 RCLK 的示波器迹线(在输出错误变化时)。

    这是一个 PCB、还是一个具有多条电缆的试验电路板? 是否有去耦电容器? 您能否显示原理图?

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    大家好、Clemens、

    感谢你能抽出时间。

    我无法注册 noice (可能稍后尝试、不确定我是否能够注册)。 用于 QH-qb 的 PCB 是用于 LCD 的简单直接输出。 RCLK 有一个 RC 集成器。

    RCLK 没有我可以寄存的 NOICE (大于0.1us)

    RC 积分器使用 C 7000pF、R 20K 和10K 进行了测试

    使用了聚酰聚合物薄膜电容器。

    已使用去耦电容器0.1uF、我是否应将其添加/更改10nF? LCD 的电流消耗为0.7mA、这可能是一个问题吗?

    此外、LCD 照明的电流约为40mA。

    此致、

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    您好!

    我的理解是、器件的时钟输入端有一个 RC 滤波器。 这可能会导致错误。

    请参阅此常见问题解答: 慢速或浮点输入如何影响 CMOS 器件? 

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    大家好、

    我 需要一些时间来检查 RCLK 的迹线。

    BTW:在我的案例中、74HCT 的使用能否改善其功能?

    此致、

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    HCS (具有施密特触发输入)将是更好的选择。

    但您应该消除问题的实际根源。

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    大家好、

    抱歉、无法向您发送跟踪、没有机会获取。

    还有 其他建议吗?

    此致、

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    大家好、

    是否  有任何更新?

    此致、

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    您好!

    我不确定您请求的是什么更新。 我们不处理此问题、因为您尚未提供任何进一步的详细信息。