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[参考译文] LSF0204D：LSF0204DRUTR 的传播延迟

admin
Guru**** 2386610 points
Other Parts Discussed in Thread: LSF0204, TMUX1574, SN74AXC4T774
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/999447/lsf0204d-the-propagation-delay-of-lsf0204drutr

器件型号：LSF0204D
主题中讨论的其他器件：LSF0204、 TMUX1574、 SN74AXC4T774

您好、德克萨斯州：

我们想知道 LSF0204DRUTR 的传播延迟

我还查看了之前的问题页面"LSF0204： LSF0204RUTR 的传播延迟"  

您说过、负载电容和 电阻以及任何上拉电阻都会影响 传播延迟

由于我们的 SPI 拓扑 Tclk 频率为66MHz、电平位移元件的延迟时间预算需要为1ns 或至少低于1.5ns

从 VDD 1.8V 到 VDD 3.3V、我们的 P3V3上拉电阻为10K、无 负载电容和 电阻

该电平位移是否可以满足延时时间要求？

谢谢

Nick

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    TI__Guru**** 2386610 points
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    嗨、Nick、

    您能否指定无负载电容或电阻的含义？ 这只是浮动还是连接到另一个器件？ 该器件引脚仍将具有一些负载。 根据负载、您可以估计这是否起作用。

    建议您观看此培训视频、其中介绍了 LSF 系列器件的翻译。 它还介绍了该公式、并提供了一个有关在上拉电阻器与数据速率之间实现平衡的示例

    https://training.ti.com/translation-lsf-family-0?cu=1134826

    谢谢、
    Rami

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    TI__Guru**** 2386610 points
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    你(们)好，Rami

    感谢您的介绍、我 观看了视频

     但它仍然无法解决这个问题

    这是我们的 SPI 方框图、串联拓扑仅在电平位移的 B 侧放置10K 上拉电阻器

    如何评估 电平位移的延迟时间？ 是否至少 低于1.5ns？

    谢谢你

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    TI__Guru**** 2386610 points
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    这取决于整个信号线路上的总电容。 走线越长、器件越多、电容就越大。

    我们不知道您的电路板、因此无法估算。 找出问题的最佳方法是 使用 示波器查看实际信号形状。 如果上升沿太慢、则必须在 B1处使用更强的上拉电阻(这需要 CPU 提供更多的驱动强度)。

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    TI__Guru**** 2386610 points
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    你好、克莱明

    我得到了您的建议、  如果需要、我们将在下一阶段使用示波器来关联我们的发展

    我确实需要 电平位移的传播延迟、以确保66MHz SPI 拓扑在早期阶段是安全的。

    例如、多路信号分离器也是 TI 产品、TMUX1574数据表中存在传播延迟

    我可以找到拓扑中所有元件的延迟时间、但 LSF0204DRUTR

    如果 LSF0204DRUTR 的传播延迟大于1.5ns、我们将 在早期阶段进行更改  

    谢谢

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    TI__Guru**** 2386610 points
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    在数据表第7.8节指定的测试条件下、典型传播延迟小于1.5ns、但最大值不是。

    在 kΩ μ s 的情况下、上升沿将更慢。

    最快的替代产品是 SN47AXC4T774。 它是缓冲电平转换器、因此速度更慢。

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    TI__Guru**** 2386610 points
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    你好、克莱明

    您能否提供"数据表第7.8节中指定的测试条件"和"SN47AXC4T774的数据表"？

    谢谢

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    TI__Guru**** 2386610 points
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    您好！

    数据表 中的值



    为了帮助您定义 TPLH、tphl、tplz 和 tpzl：




    AXC 器件的器件型号中有一个拼写错误。 47应为74。
    该部件清洁剂是指 SN74AXC4T774
    这是 数据表

    谢谢、
    Rami