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[参考译文] SN74AVC2T244：上升和下降时间

admin
Guru**** 1688270 points
Other Parts Discussed in Thread: SN65MLVD203, 2N7001T, SN74AVC2T244, SN74AXC2T45
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/874755/sn74avc2t244-rise-and-fall-times

器件型号：SN74AVC2T244
主题中讨论的其他部件：SN65MLVD203、 2N7001T、 SN74AXC2T45

SN74AVC2T244DIH 线

我将1.8V 输出 FPGA 连接到将以100MHz 运行的3.3V MLVDS 系统。  我计划将1.8V FPGA 输出馈入 SN74AVC2T244或2N7001T、然后馈入 SN65MLVD203。  接收器将是一个 MLVDS 兼容 FPGA。  这些器件的数据表规定位速率为100Mbps 及更高。  我的问题是、这些部件的上升和下降时间是多少？  欢迎使用任何其他解决此问题的方法。  感谢你能抽出时间。   

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    TI__Guru**** 1688270 points
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    尊敬的 Dennis：

    SN74AVC2T244是双通道单向器件、而2N7001T 是单通道。 您是否计划使用其中的2个？ 由于工作频率为100Mhz (200Mbps)、因此我建议考虑使用 SN74AXC2T45器件(2通道)来支持数据表特性中所述的这种高频率(高达380Mbps)。

    上升和下降时间取决于电容负载、与高阻抗输入连接通常意味着上升/下降时间将小于5-7ns。  

    分立式电压转换的常见风险应用手册(http://www.ti.com/lit/an/scea062a/scea062a.pdf)对2N7001T 进行了仿真、3.3V 转换的上升时间为2.2ns。 SN74AXC2T45的输出驱动与2N7001T 相似。

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    TI__Guru**** 1688270 points
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    感谢您的快速响应。  就容性负载而言、FPGA 接收器和发送器应符合 TIA/EIA-899 (多点低压差分信令(MLVDS)的电气特性)标准。  这大约是2.5pF 差分和3pF 共模。  您对 该负载的上升和下降时间的猜测是多少？  SN74AXC2T45是一款很好的器件、但我的总线将是全双工、因此我不需要改变方向。  

    问：SN74AVC2T244是双通道单向器件、而2N7001T 是单通道。 您是否计划使用其中的2个？

    答：由于 PCB 布局的拓扑结构、我将同时使用 SN74AVC2T244和2N7001T。  

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    TI__Guru**** 1688270 points
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    尊敬的 Dennis：

    在如此低的负载下、上升和下降时间通常不会超过5ns

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    TI__Guru**** 1688270 points
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    很抱歉、我忘记说这是一种背板设计 、可以 有多达32个插槽(32个 MLVDS 负载)。

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    TI__Guru**** 1688270 points
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    您是说一个输出通道(2N7001T/AVC2T)驱动32个负载(每个负载为3pF)吗？ 那么、总负载大约为100pF？

    在这种情况下、上升时间可能为~8-12ns。 您可以使用2N7001T 或 AVC 的 IBIS 模型来评估计时。

    我通过 RC 负载计算该值。

    R =(Vcc-VOH)/IOH

    =~33 Ω

    3RC =~10ns 上升时间。

    通常、它将低于该值。