[参考译文] SN74AVC4T774：加电期间需要终端非驱动输入？

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Other Parts Discussed in Thread: MSP-EXP430F5529LP, SN74AVC4T774, SN74AXC4T774

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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/871836/sn74avc4t774-termination-undriven-input-required-during-power-up

器件型号：SN74AVC4T774
主题中讨论的其他器件：MSP-EXP430F5529LP、 SN74AXC4T774

您好！

我们计划在加电后从 Xilinx RFSoC 驱动'774的输入。因此、当 RFSoC 启动并配置其输出引脚时、如果未驱动774个输入、上电后可能会有一段很短的时间(毫秒)。是否有必要在'774输入端提供下拉电阻器、以确保即使在这段短暂的时间内也会终止这些电阻器并且不会悬空？或者、是否没有必要、在这么短的时间内使输入悬空不会损坏任何东西？

谢谢、Ted

6 年多前

0 admin 6 年多前

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输入悬空可能导致两个问题：交叉电流和振荡。第一种情况发生在输入电压不在电源轨上且相对良好的情况下(尤其是在仅发生短时间时)。当输入电压接近开关阈值时、会发生第二种情况、这可能很危险。但是、为了使输入电压达到开关阈值、需要允许输入浮动足够长的时间。

此线程显示了由 MSP-EXP430F5529LP 板上的七个悬空输入引脚引起的额外功耗示例：

它会浮动、但相当缓慢。 (由于 MSP 具有施密特触发输入、因此不会出现振荡。)

如果 SN74AVC4T774输入端的走线相对较短、并且电路板或环境中没有太多的电气噪声、则开路输入端的电压将不会有机会产生明显的漂移。

0 admin 6 年多前

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尊敬的 Ted：

除了 Clemens 的输入、您还可以切换到 SN74AXC4T774、这在这种情况下也会有所帮助。它旨在提高加电性能、从而消除任何毛刺脉冲。

0 admin 6 年多前

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非常感谢 Clemens 和 Dylan 提供的信息。

是的、如果您建议使用 AXC 来避免加电干扰、我们可以切换至 AXC。我计划通过使用 OEN 引脚使器件保持禁用状态、直到两侧的电源稳定、从而避免此类干扰。但是、这样做可能会导致两侧的输入在更长的时间内不被驱动。我看到 AXC 器件数据表包含的警告与未使用(或未驱动)输入必须保持在 GND 或 VCC 以确保正常运行相同。我假设该警告仍然适用、即使器件被 OEn 引脚保持禁用状态？因此、在我看来、为了安全起见、我需要始终将器件 A 侧和 B 侧的输入端接至 VCC 或 GND、包括器件何时被禁用？我认为、如果器件始终处于启用状态、则只端接器件的输入侧就足够了、因为输出侧将被驱动至相同的电平、从而端接输出侧的输入缓冲器。这种推理是否正确？

另一个问题：我们还使用 SN74AVC1T45DRL single-bit 收发器。由于此器件没有可用于禁用输出的 OE 输入、直至两侧的电源稳定、我认为切换到具有电源定序干扰抑制功能的器件的 AXC 版本更为重要？

再次感谢、Ted

0 admin 6 年多前

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如果您真的想确定、请添加弱上拉或下拉。

0 admin 6 年多前

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谢谢 Clemens。因此、我可以正确地说、使用 OEn 引脚禁用输出不会减轻浮动输入的问题？

Ted

0 admin 6 年多前

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OE 引脚确实只影响输出。

0 admin 6 年多前

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嗨、Ted、

通过 OE 引脚禁用 I/O 可能会导致以下器件输入的输入出现问题、因为该输入现在将悬空。如果您不打算更改通道的方向、那么只关注电平转换器的输入是可以的(因为正如您所说的、当未禁用时、输出将始终处于驱动状态)。

如果仅是您关心浮动的 I/O、则 AXC774的毛刺脉冲抑制电路应有助于在没有驱动这些线路的情况下将其保持在低电平、因此不需要额外的弱下拉电阻。但是、控制输入(例如 Dir 和 OE)应该始终具有被驱动的状态。

要回答您的另一个问题、是的、您是对的、在这种情况下、AXC1T45将是更好的选择、因为您无法控制 AVC1T45在上电期间输出的反应(无法禁用输出)

逻辑（参考译文帖）

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