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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/958329/lsf0108-abnormal-rise-edge-of-output-of-lsf0108
尊敬的 TI：
在这里、我们在使用 LSF0108时遇到了一个问题。 下面是原理图。 V1.8侧为输入、而 V3.3侧为输出。
我们观察到、3.3V 输出上升沿的转换速率有时会变慢。 在下面的波形中、黄色表示 A1引脚、蓝色表示 B1引脚。 您能帮助解释一下这种异常现象吗？ 谢谢。
这些过冲看起来好像3.3V 器件主动将线路驱动为高电平。 SD 协议是否是双向的？ 我怀疑只有当3.3V 侧为输出时、您才会获得慢速边沿。
您好、Ladisch、
但为什么只有这个位的边沿较慢、而其他位则较快。 但是、什么会导致这种情况缓慢呢？
当3.3V 器件将线路驱动为高电平时、您将获得快速边缘。 当1.8V 器件将线路驱动为高电平时、您会得到一个慢速边沿、因为超过1.8V 的电压仅由上拉电阻器弱驱动。
您好！
是的、克莱明是正确的。
当线路从3.3V 侧主动驱动为高电平到1.8V 侧时、您将获得一个快速边沿。
当您尝试以相反的方向运行并从1.8V 向上转换到3.3V 侧时、 3.3V 侧将仅通过外部上拉电阻器上拉、因此将具有 RC 曲线响应、而不是从低阻抗驱动器看到的边沿。
最棒的 Michael
