大家好、
在这里了解您很高兴。 我的客户需要 TI 解释以下现象、
当 VCCA 断电时、
DIR 连接到高电平、
输入信号为低电平、
4.来自 VCCA 的 OE 电源
即使 A1为低电平、我们也可以在 B1中进行1.5ms 脉冲。 请帮助检查可能导致此问题的原因吗? 谢谢。
BR、
查尔斯·林
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大家好、
在这里了解您很高兴。 我的客户需要 TI 解释以下现象、
当 VCCA 断电时、
DIR 连接到高电平、
输入信号为低电平、
4.来自 VCCA 的 OE 电源
即使 A1为低电平、我们也可以在 B1中进行1.5ms 脉冲。 请帮助检查可能导致此问题的原因吗? 谢谢。
BR、
查尔斯·林
嘿、Charles、
好的、蓝色波形未连接到我们的器件。 当您关闭 VCCA 电源时、您将器件置于未知的运行区域(OE 和 DIR 电路以 VCCA 为基准)、以便在 Ioff 电路禁用 I/O 之前、可以在输出端看到类似这样的脉冲。 我们有一个新器件、该器件具有消除此类问题的功能(请参阅 此处 了解产品文件夹)。 否则、它们可能需要在断电时保持 OE 引脚为高电平、以保持 I/O 处于禁用状态、直到 Ioff 电路激活。
。