This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] SN74LVC07A:SN74LVC07A

Guru**** 2537490 points
Other Parts Discussed in Thread: SN74LVC07A, SN74LVC1G34

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/944306/sn74lvc07a-sn74lvc07a

器件型号:SN74LVC07A
主题中讨论的其他器件: SN74LVC1G34

我们在设计中使用了 SN74LVC07A。 6个栅极中的一个用于 8MHz 时钟信号的栅极、但我们无法从 SN74LVC07A 获取适当的输出。

因此、请帮助我们解决问题。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    为什么要使用具有漏极开路输出的器件? 您是否需要电平转换?

    我怀疑上拉电阻太弱、这会使上升沿变得太慢。 请使用示波器进行检查、并减小电阻器值、直至获得合适的方波。

    最好的解决方案是尽可能使用具有推挽输出的缓冲器(例如 SN74LVC1G34)。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    e2e.ti.com/.../Buffer_5F00_Wave-Form.pdf

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    我们使用开漏输出、因为 SN74LVC07A 栅极输出连接到 CMOS IC。

    因此、我们使用 了十六进制缓冲 器 SN74LVC07A

    此外、我还尝试了减小的上拉电阻器、直至330E、但8MHz 时钟信号仍然显示不正确。 以了解随附的示波器捕获的更多详细信息。

    如果我们使用74LVC125、则时钟信号显示正确的形状。 但我们需要具有多个栅极的开漏缓冲器。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你好 Sachin、

    在8MHz 时、脉宽仅为62.5ns。 对于开漏驱动器而言、这非常快。

    假设10%至90%的上升时间需要为20ns。 在您的案例中,我根据提供的波形进行了快速计算,您的负载看起来是~37pF --计算基于330欧姆上拉电阻器的~62.5ns 上升时间。

    对于 RC 电路,10%到90%的上升时间为2.2*R*C,我们知道 C 和所需的时间,因此我们可以计算所需的上拉电阻:

    T_RISE = 2.2*R*C

    R = t_rise /(2.2*C)

    R = 20ns/(2.2*37pF)= 246欧姆

    在3.3V 时、当 LVC 器件处于低电平状态时、最终每通道的电流将为3.3/246 = 13.4mA。 它在每个通道上的额定处理电流为24mA、同时保持 VOL 规格、并可通过 GND 维持高达100mA 的总电流(6*13.4 = 80.4mA、因此没有问题)。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    该100 Ω 串联电阻也会影响上升时间。 将其放低、拆下或更换为铁氧体磁珠。