[参考译文] CD4050B：CD4050B

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Other Parts Discussed in Thread: CD4098B, CD4050B, CD4013B

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/943342/cd4050b-cd4050b

器件型号：CD4050B
主题中讨论的其他部件：CD4098B、 CD4013B

你好

我希望使用以下 Cktt 为我们的三级逆变器创建最小脉宽。

每腿应使用四个此类 Ckts。目标脉宽约为800nS 至1.1us

和关断时的电流。

PS 为+15V、输入信号也为0-15V。

我有以下问题：

在负转换点、输入将暂时拉至 GND 以下

其中、内部钳位二极管应通过 O/P 级的 Rdson 复位330pF 电容。

内部钳位二极管(至 GND)是否适合重复使用？

2.在正转换点、输入应高于+15V。

它是否会破坏重复脉冲？

3.如果我选择在输入端采用串联二极管，则任一端连接+15和 GND

但不要在330pF 电容器上插入限值电阻器、这是可以的吗？

谢谢、此致

瓦伦

3 年多前

0 admin 3 年多前

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该图像如下所示-

0 admin 3 年多前

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内部钳位二极管的绝对最大额定值为10mA。您的电路将超过此值。

添加外部肖特基二极管会有所帮助。

是否可以改用 CD4098B？

0 admin 3 年多前

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尊敬的 Varun：

我建议不要使用下面的电路。预期的开关电压为 VCC/2、二极管两端的电压为7.5V。

当从低电平切换到高电平时、输入电压将被强制为22.5V、这会立即破坏 CD4050B 的输入栅极。

当从高电平切换到低电平时、输入电压将强制为-7.5V、这可能会由于过流而损坏输入二极管(其额定电流仅为10mA)。

此外-电路似乎不会在输出端产生脉冲、只是输入的复制、具有轻微延迟和增加的电压/电流尖峰。

我建议改为使用基于 XOR 的边沿检测器-稍微延迟一个输入将在每个输入边沿上产生正输出脉冲、包括正输出脉冲和负输出脉冲。 XNOR 可用于负脉冲。

0 admin 3 年多前

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非常感谢 Clemens 和 Emrys 的回复。

虽然您所说的大部分内容对于许多应用都是有效的、

在我的特定情况下、它们不是。

它实际上是我们的短脉冲抑制电路的变体、我需要一些器件

我的三级逆变器驱动器每桥臂4个 N。

我的目标规格如下：

输入脉冲序列：FSW 最大值为10kHz。

对于正脉冲和负脉冲、短于900nS +/- 200nS 的脉冲将被终止。

上升沿和下降沿的等效延迟、虽然不是 reqd、但是可以容忍的。

CKT 可操作@+15V (Alas，限制了选项！！)

四个这样的 Ckts 组合在一起、占用空间和封装数量确实很重要。

了解 Clemens 的回复、如果我将肖特基二极管对置于输入端、钳位到 PS 电源轨、

如果 CD4050的 O/P 级需要、我是否还需要将一个电阻器与电容串联？

谢谢、此致

瓦伦

0 admin 3 年多前

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添加到我的预发邮件中。

具有施密特触发器的简单 R-C Cktt 为什么我不喜欢？

通常符合规格、但有以下问题：

当说上升时、当 Vth+被交叉时、O/P 切换、和

输入会以毫伏的方式开始下降。

在这种情况下，时间通常由(Vth+- Vth- only)确定

它从 Vcc 到 Vth-表示下降、从0到 Vth+表示上升。

在这种情况下、对于保证的最小短路脉冲、该 SPS 时间的扩展

变得不可接受的大。

此 Cktt 可避免该问题、因此首选。

此致

瓦伦

0 admin 3 年多前

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对于抗尖峰脉冲电路、您需要一个多谐振荡器(½ CD4098B)和一个 D 型触发器(½ CD4013B)。将输入信号连接到多谐振荡器的两个触发输入(+TR 和−TR)和触发器的数据输入(D)。将多谐振荡器的反相输出(Q)连接到触发器的时钟输入(C)。将多谐振荡器的 RESET 输入连接到高电平、并将触发器的 SET 和 RESET 输入连接到低电平。将多谐振荡器的 R×C 配置为900ns。

输入信号中的任何边沿都将触发(或重新触发)多谐振荡器。这意味着它的 Q 输出变为低电平并保持低电平、直到配置的时间结束、而输入上没有任何新的边沿。

当 Q 变为高电平并触发触发触发触发器的时钟时、输入的新稳定状态会复制到触发器的 Q 输出。 (在干扰之后、新状态与旧状态相同。)

0 admin 3 年多前

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你好、克莱明

一个很棒的 Ckt,我以前也用过。

如果我只有一个(或两个 Ckts)是理想的；但是

在这里、我需要四个这样的器件、并且需要2个 CD4098和2个 CD4013。

如果可以调整我的电路、一个 CD4050封装就足够了。

转到我的初始 Ckt:

如果我使用双肖特基二极管钳制输入、则钳位到 PS 轨

(为了保护内部钳位二极管)我还需要放置

与电容器串联的电阻器、以保护 O/P 级？

如果是、该电阻器的最小值可能是多少？

感谢您的及时响应。

此致

瓦伦

0 admin 3 年多前

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输出电流没有绝对最大额定值。

使用 RθJA 来得出最大功率耗散、并对照实际功率耗散(VOL×IOL 或 VOH×IOH /通道)进行检查。调整电阻器的大小、使电流足够低。

0 admin 3 年多前

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你好、克莱明

非常感谢您的回答。

如果我没有放置任何外部电阻器、则只放置内部 Rdson

如果我正确阅读数据表、会起作用：

Rdson ( H ) 4.5V/15ma =300E 最坏情况

Rdson ( L ) 2V/32mA =62.5E 最坏情况。

这些 Rdson 的耗散能量在每个边沿上应为1/2 C*V^2；或者

E = FSW X C*V^2、@ 10kHz 和 330pF、功耗为0.74mW

四个此类栅极的总功耗为3mW。

对于 D (SOIC)封装，Rth j-a AS 81.2*C/W，Delta T 极小。

您是否足够粗略地查看我的计算结果以进行检查

如果我没有犯任何令人震惊的错误。

谢谢、此致

瓦伦

0 admin 3 年多前

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不应计算随时间变化的总能量、因为必须在任何时间点限制功率耗散。

如果我们允许+25°C 的温度偏移、则最大功耗约为300mW、即每通道75mW。

当输出刚刚切换时、电容器几乎会将输出短路至±15V (减去二极管压降)。图6-3…6-6未显示最大电流(其中功率耗散最高)、但我们可以看到15V 时的电流过高。

kΩ 在输入端前面添加一个1.5k Ω 电阻器、将二极管电流减小到10mA 以下、则输出电流也小于10mA、即使在最坏的情况下也是安全的。

逻辑（参考译文帖）

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