请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
器件型号:SN74LVC8T245-Q1 主题中讨论的其他器件:SN74AXC8T245-Q1
我在 SN74LVC8T245-Q1数据表中看到以下注释:
"为了确保加电或断电期间的高阻抗状态、应通过一个上拉电阻器将 NOE 连接到 VCC "
对于通过 DIR 引脚指定为输入的引脚、这是否也是一个要求? IE、如果 DIR 连接到 Vcca、并且 NOE 在整个上电过程中连接到低电平、是否存在启用 A 端口和后驱动的风险?
如果 DIR 和 NOE 在 Vcca 被拉高时都与 Vcca 相连、那么 NOE 被拉低、然后 Vccb 最后被拉高、该怎么办?