This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] TXS0104E:TXS0104E 状态确认

Guru**** 2538930 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/868473/txs0104e-txs0104e-status-confirm

器件型号:TXS0104E

尊敬的 TI:

请帮助查看以下原理图、暂停我们要将信号从 PCIe_reset_N_3P3传输到 PCIe_reset_N、并由控制器接收、当 PCIe_reset_N_3P3为高电平时、控制器接收到高电平信号、当 PCIe_reset_N_3P3为低电平时、控制器接收到低电平信号、 但是、如果我们 暂停 PCIe_reset_N_3P3、 控制器也接收 到高电平信号、我认为这是异常状态。

那么、您能否给我们一些建议、当 PCIe_reset_N_3P3挂起时、控制器可以接收低电平信号。 (我们尝试使用下拉电阻、但它不起作用。)

谢谢你。

暂停

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Derek:

    我们不建议在 TXS/TXB 上使用外部上拉或下拉信号。

    TXS 具有内部10k 上拉电阻器、因此其各自的 Vcc 侧默认 IO 状态为高电平。 即 A 端口连接 Vcca、B 端口连接 Vccb。

    为了使输出为低电平、必须接合/置位 OE 引脚、从而将 IO 端口从10k 上拉电阻器上断开。 通过非常弱的下拉电阻(100k)、IO 端口将为低电平。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬 的 Shreyas:

    感谢您的回复。

    那么、您能否为我的应用提供一些建议、我想使用 IC 进行正常电平位移、 并且控制器需要 在 PCIE_RESET_N_3P3暂停时接收低电平信号、 谢谢。

    或者、您能否提供合适的 IC 作为参考、谢谢。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    "暂停"到底意味着什么? 这一侧的电源是否也会消失? 是否有指示此状态的控制信号?