[参考译文] SN74LVC1G74：SN74LVC1G74

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Other Parts Discussed in Thread: SN74LVC1G74, SN74HCS74

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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/861771/sn74lvc1g74-sn74lvc1g74

器件型号：SN74LVC1G74
主题中讨论的其他器件： SN74HCS74

您好！

我在设计中使用的是部件"SN74LVC1G74"。电路如下所示。在这种配置下、我的输出(Q)在电源上电后有时会变为高电平、有时会变为低电平。我需要输出在通电后始终处于"低(Q)"状态。请帮助我解决此问题。

V_buff 为5V

从处理器驱动 SET & REST 引脚。我为这两个引脚放置了上拉电阻器、并将电容器放置在 RESET 引脚上以实现上电复位。

此致

Anuraj NK

5 年多前

0 admin 5 年多前

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请显示上电时 VCC、CLR#和 Q 的示波器迹线。

0 admin 5 年多前

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尊敬的 Anuraj：

我认为、Clemens 在使用示波器布线时可能会遇到的情况是、在 Clear 引脚上输入信号的速度可能太慢、无法使电路正常工作。我建议您切换到 SN74HCS74、它附带施密特触发输入。不建议在没有施密特触发输入的器件上使用类似的 RC。如果您打算使用 LVC 器件、我建议您在清零引脚前面使用施密特触发缓冲器。

这是一个逻辑分钟视频、其中使用触发器作为按钮。

https://training.ti.com/convert-momentary-switch-toggle-switch?context=1134826-1139263-1136772

谢谢！

卡兰

0 admin 5 年多前

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您好、Karan、

感谢您的重播。添加附加电路的时间太晚了、因为电路板是制造的。

我是否可以使用一个连接到 CLR 引脚的下拉电阻器、以便在其上电后、输出(Q)将为低电平。

此致

Anuraj NK

0 admin 5 年多前

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CLR#上的下拉电阻会使边沿更慢。

但我们还不知道发生了什么；请显示示波器迹线。

0 admin 5 年多前

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尊敬的 Anuraj：

我们从您那里听说过、现在已经有一段时间了、因此我假设您能够解决这个问题。如果不是、请随时在此主题上再次发帖、我们可以继续提供支持。我相信我们想要一些示波器快照、以便更好地查看您遇到的问题、因此如果您需要进一步的支持、请提供这些示波器。

逻辑（参考译文帖）

逻辑（参考译文帖）(Read Only)

[参考译文] SN74LVC1G74：SN74LVC1G74