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[参考译文] SN74AVC4T245：关于高阻态输入

admin
Guru**** 2387080 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/811584/sn74avc4t245-about-hi-z-input

器件型号：SN74AVC4T245

尊敬的支持团队：

如果客户将 OE =L、DIR=L 且 B 端口输入源设置为高阻态、端口输出 是否也为高阻态？  如果不是、A 端口输出的状态是什么？ 太多了！

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    TI__Guru**** 2387080 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好！

    如果！OE 引脚被设定为低电平、则 A 和 B 引脚将处于正常运行状态、但是如果！OE 被设定为高电平、则二者均处于高阻态。 此表是否回答了您的问题？ 如果没有、您可以澄清 B 输入条件？

    此致、

    Gabriel

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    TI__Guru**** 2387080 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    当 DIR 为 L 时、B 输入处于活动状态、并且必须始终驱动至有效的逻辑电压(请参阅[常见问题解答]慢速或浮点输入如何影响 CMOS 器件？)。

    如果 B 输入悬空、则读取随机值(低或高)、该值将输出为 A