你(们)好。
从应用报告《慢速或浮点 CMOS 输入的影响》(SCBA004D)中、我了解 到慢速输入信号边沿速率或转换时间可能是需要考虑的问题。
我已经阅读了一些74HCT*数据表,这些器件在大约5V 的电压下工作时,通常具有大约500ns 的输入信号转换时间
而基于非常先进的高速 CMOS 技术(例如74LVC 系列)的逻辑元件对输入信号的要求要严格得多、即指定最大输入边沿速率 10ns/V
现在 、SN74LVC1G17数据表未说明输入信号的上升时间和下降时间规格(尽管在第10.2.2节中它们是基准)。
这是为什么? 是否在错误中省略了它? 这是因为缓冲器是基于施密特触发器且具有输入迟滞的设计吗? 或者、我应该更改为假设74LVC 系列的最大输入转换速率为"平均" 10ns/V
在我们开启时、基于双极的逻辑元件是否存在类似的限制、例如74LS...?
谢谢!
Daniel