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[参考译文] SN74LXC1T45-Q1:DATA 引脚下拉

Guru**** 605955 points
Other Parts Discussed in Thread: AVCLVCDIRCNTRL-EVM, SN74LXC1T45-Q1
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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1238073/sn74lxc1t45-q1-data-pin-pull-down

器件型号:SN74LXC1T45-Q1
主题中讨论的其他器件:AVCLVCDIRCNTRL-EVM

您好!

在我的当前设计中、我将一个3.3V 电源连接到 VCCA、并将一个分压器网络连接到一个大约为3.3V 的电源。 运行期间、引脚 A 上的下拉电阻是多少?

在数据表中、我看到第8.3.1节中、最坏情况下的电阻是使用最大输入电压和最大输入漏电流计算得出的、因此从这里我计算得出的电阻应该是3.25M Ω。 但我还在第8.3.1.1节中看到、I/O 引脚在禁用期间具有一个100k 的下拉电阻。 引脚 A 在运行期间是否仍具有此100k PD、还是更改为3.25M Ω? 计算分压器的电阻值时、是否需要考虑此内部下拉电阻?

此外、SN74LXC1T45-Q1是否可以与 AVCLVCDIRCNTRL-EVM 板配合使用?

此致!

卢卡斯

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    您好、Lucas:

    μ 100kΩ 仅在禁用期间的短时间内导通、而不是在器件正常运行时导通。 您说最坏情况下的电阻为3.25MΩ Ω 是正确的、但是、如果您使用上拉电阻、我们建议不要超过15kΩ Ω。

    是的、LXC1T45可以与 AVCLVCDIRCNTRL-EVM 一起使用、但仅与 DCK 封装一起使用。

    此致、

    约什