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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1290486/sn74alvch16245-about-bus-hold-function
为什么不建议使用上拉和下拉寄存器？
我将总线保持电路识别为一个电路、如图1所示。
是否在逻辑图中省略？(图2)
e2e.ti.com/.../figure.pdf
总线保持电路已经像上拉/下拉电阻器一样工作。 外部上拉/下拉电阻将沿同一方向(因此不需要该电阻)或相反的方向(因此它会形成一个分压器、使输入电压无效)。
逻辑图只是一个概述；总线保持电路仍然存在。
