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[参考译文] SN74LV123A:未获得预期输出:Q &Q#始终分别为高电平和低电平。

Guru**** 691310 points
Other Parts Discussed in Thread: SN74LV123A
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1318678/sn74lv123a-not-getting-expected-output-q-q-is-always-high-and-low-respectively

器件型号:SN74LV123A

您好!

我们将 在设计中使用 SN74LV123A IC。 我们希望输出为按照随附图像突出显示的真值表。

我们的电路如下图所示。  

输入 B 如下面的附加图像所示。 其他输入如下所示。 #A =始终为低电平、#CLR=始终为高电平。

输出 Q 始终为高电平、Q#始终为低电平。 我在输出中没有看到任何变化。 我们期望 在输入 B 的上升沿产生持续时间为100ns 的脉冲。  

您能否查看并告诉我、原因可能是什么? 设计中有任何问题?

谢谢。此致、

桑托什

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    我发现了错误。 这是因为使用了 Rext 值。 我们使用了100E 电阻器。 但是根据数据表、5V 电源的最小电阻为1K。 当我们将其更改为1K 时、我们获得了输出。

    我的问题已解决。 谢谢!