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[参考译文] SN74AXC8T245-Q1:输入转换上升或下降速率和奎特的定义;

Guru**** 1495795 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1359671/sn74axc8t245-q1-definition-of-input-transition-rise-or-fall-rate

器件型号:SN74AXC8T245-Q1

专家、您好!

我们想确认"输入转换上升或下降速率"的定义。

数据表中指出"输入转换上升或下降速率"应小于10ns/V。

它是否仅适用于像 VIH-VIL 阈值那样的无效电压范围?

我确认的、E2E 中有2种类型的描述、如下所示。

仅适用于无效电压范围: https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1248011/sn74lv06a-about-l-transition-rate-specification/4725650?tisearch=e2e-sitesearch&keymatch=Input%252525252525252520transition%252525252525252520rise%252525252525252520or%252525252525252520fall%252525252525252520rate#4725650

它适用于 Edge 的所有点: https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1183935/sn74avc6t622-about-input-transition-rise-or-fall-rate?tisearch=e2e-sitesearch&keymatch=Input%25252520transition%25252520rise%25252520or%25252520fall%25252520rate#

我认为逻辑电路输入的上限和下限拐点应该比中点慢、因为逻辑输出级是恒定电压驱动。
如果我们对所有斜率点都应用了此要求、则很难确认它是否在推荐范围内、因为没有像压摆率(10%<=>90%)这样的任何明确标准。
此外、该限制是为了避免输入不明确导致的振荡和击穿电流、因此该要求在电压电平清除之前就足够了。

因此、我认为该限制仅适用于无效的电压范围、但 E2E 上有一些不匹配的答案、因此我想确认一下。

此致、
仓口和树

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    尊敬的 Kazuki:

    请注意、转换速率是根据电压测量的。 即、例如10ns/V 表示输入需要以每1V 10ns 的速率转换、并阐明了如何计算 VIL/VIH 限值的10至90%的阈值、因为转换1V 可以处于任何 VIL/VIH 电平、具体取决于 VCC 是多少。

    因此、如果您从 VIL/VIH 角度来看、10ns/V 在不同的 VCC 电平下可以具有不同的阈值。 一.30. E 1.2V VCC 可能具有比0.9V VCC 更高的裕度、因为每个1V 只需要快于10ns。  

    此致、

    迈克尔.  

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    该限值适用于 VIL 和 VIH 之间的所有边沿点。 (当电压介于 VIL 和 VIH 之间时、会出现击穿电流、因此您需要将此间隔内的时间缩短。 当开关阈值处出现慢速边沿时、会发生振荡、该边沿介于 VIL 和 VIH 之间、但通常接近 VIL/2 VCC。)

    (我在第二个相关问题中的答案是不完整的;我想要强调的是、您不能将斜率计算为 VIL 和 VIH 之间的平均值。)

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    您好、Michael、Clemens、

    感谢您的描述。

    我知道输入转换上升到下降速率应该适用于 VIL-VIH。

    客户用例是输入侧 VCC 为3.3V、因此将为0.8V 至2V。
    因此、实际所需的时间将短于12ns。

    此致、
    仓口和树