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[参考译文] SN74LV74A:CLK 之前的设置时间

Guru**** 1565925 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1370410/sn74lv74a-set-up-time-before-clk

器件型号:SN74LV74A

工具与软件:

大家好、

如果输入信号无法满足 tus 要求、输出会发生什么情况?
是否会错过输入信号? 或者会发生其他问题吗?

此致
大桥

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    输入信号可能缺失、或触发器可能会进入亚 稳态(可能性较低);请参阅5V 逻辑电路中的亚稳态响应。

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    您好、Clemens:

    感谢您的支持。  

    您能否告诉我们、进入亚稳态周期通常需要多长时间?

    此致
    大桥

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    几乎是随机的。

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    您好、Clemens:

    感谢您的答复。 它像是几个~μ s 次序吗? 或者是否有可能 需要几秒钟的时间恢复?

    此致
    大桥

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    我想、时间越长的可能性就越小。 但没有上限。