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[参考译文] SN74LV123A:如何处理未使用的引脚

Guru**** 1568615 points
Other Parts Discussed in Thread: SN74LVC1G123, SN74LV123A
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1385452/sn74lv123a-how-to-handle-unused-pins

器件型号:SN74LV123A
主题中讨论的其他器件:SN74LVC1G123

工具与软件:

尊敬的专家:

我想知道如何处理未使用的引脚。

[问题]
将 Rext 和 Cext 引脚连接到 GND ->发热异常
*打开 Rext 和 Cext 引脚->无异常发热
[问题]数据表并未介绍如何处理未使用的引脚
问题1。  请告诉我如何处理未使用的 引脚
问题2: 我们为什么要这样做呢? 请清楚地告诉我原因。
此致、
Susami
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    这是奇怪的。 我不明白大电流会在哪里流动。 让 Cext/Rext 引脚悬空听起来并不好。

    总之、只需使用 SN74LVC1G123。

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    您好、Clemens:

    感谢您推荐另一款器件。 但由于我的客户计划使用 SN74LV123A、因此 我们想知道如何使用此器件。  

    还有什么其他想法可以解决这个问题吗? 或者、我应该向客户询问一些信息吗?

    顺便说一下、竞争器件(HD74LV123A)有以下 描述:

    '未使用电路的输入引脚应该在用于固定输出的条件下使用、以避免出现噪声故障。 此外、建议 Rext / Cext 端子是断开的、外部器件不连接。"

    https://www.renesas.com/jp/ja/document/dst/hd74lv123a-rej03d0314-0600z?language=en&r=527206

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    尊敬的广目:

    幸运的是、我们具有适用于这些器件设计的内部原理图。 我仔细观察了一下、我认为可以将这些引脚保持悬空。

    此致!

    Malcolm

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    尊敬的 Malcolm:

    感谢您提供的信息。 如果可能、您想知道为什么将这些引脚保持悬空是可以的吗?您能了解什么信息吗?  

    此致、

    广目

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    尊敬的广目:

    这些信号并不与 CMOS 门连接、而是与漏极连接、因此在振荡或未知电压电平方面也不存在相同的问题。

    此致!

    Malcolm

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    尊敬的 Malcom:

    你是否知道为什么将  Rext 和 Cext 引脚连接到 GND 会产生异常发热问题?

    此致
    大桥

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    大桥

    在某些情况下、看起来这样可以实现从 VCC 到 GND 的连接。 我不是一名设计工程师、因此无法自信地回答。  

    此致!

    Malcolm

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    尊敬的 Malcolm:

    我的客户希望仔细检查内部电路。

    在此应用手册中、似乎只有低侧 FET 用于 Rext 和 Cext。

    https://www.ti.com/jp/lit/an/slva720a/slva720a.pdf

    但在下面的 FQA 中、Vcc 和 Rexc/Cext 之间似乎有高侧 P-FET。 在某种情况下该 FET 导致了发热问题。

    https://e2e.ti.com/support/logic-group/logic/f/logic-forum/863529/faq-how-does-a-monostable-multivibrator-one-shot-work

    哪种配置正确?

    此致
    大桥

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    你好、大桥

    第二种配置是正确的(带有高侧 PFET)。

    此致!

    Malcolm