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[参考译文] UCC28950:UCC28950PWR 在 Light Load2下的行为

Guru**** 2481985 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1466415/ucc28950-ucc28950pwr-behavior-under-light-load2

器件型号:UCC28950

工具与软件:

尊敬的 Mike 和支持团队:

我重新发布此帖子是因为相关问题已关闭、我无法发布。

在 SLUA560D 文档中、未提及相关问题最后一个答案中的具体表达式"导通延迟应该是谐振回路频率的1/4 "。

为了确定这一点、我想确认以下理解是否正确。

——
延迟时间根据谐振电路的谐振行为进行设置、以确保开关节点电压达到零的时序。 由于谐振回路中的能量像正弦波一样振荡、1/4周期代表谐振电压从最大值恢复为零的时间。 ZVS 是通过在此时间导通 MOSFET 来实现的。
——

我希望您再次查看电路图、您允许我给您发送一条私人消息吗?

谢谢!

Conor

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好!

     

    您将延迟时序设置为¼谐振频率以实现 ZVS 是正确的。  但是、在轻负载时、它将具有谷底开关。  应用手册 SLUA560d 对此进行了介绍、并显示了从50%负载到100%负载的 ZVS 图。  负载低于50%时设计谷底开关。  下图摘自应用手册 SLUA560d、显示了该行为。

    您可以做的另一件事是将设计加载到10%并精确地设置所需的延迟。  下面的显示了在您的设计中实现 ZVS 所需的时序。

     

     

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