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[参考译文] DRV8353:关于 DRV8353HRTAT 的 nFAULT

Guru**** 2442090 points
Other Parts Discussed in Thread: DRV8353

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/motor-drivers-group/motor-drivers/f/motor-drivers-forum/1387644/drv8353-regarding-nfault-of-drv8353hrtat

器件型号:DRV8353

工具与软件:

尊敬的 BLDC 团队:

关于 DRV8353HRTAT 的 nFAULT:

如果超过 MOSFETVDS_OCP 过流保护(VDS_OCP)中的 VVDS_OCP 阈值的持续时间长于 tOCP_DEG 抗尖峰脉冲时间、则会识别出 VDS_OCP 事件、nFAULT 变为低电平。
当 nFAULT 为低电平时、如果施加 PWM 输入的新上升沿、则应会清除 VDS_OCP 事件、且 nFAULT 将变为高电平。

您的问题是、当 nFAULT 为低电平并且您要清除 VDS_OCP 事件时、在 nFAULT 变为低电平之后、需要多长时间才能输入 PWM 输入的新上升沿?
我附加了一个图像。 此模式为[3x PWM]模式。

此致、

市川达也

 

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    嗨、市川山、

    感谢您的提问。 我已经指派了一名团队成员来审核问题并设定时间表预期。

    此致!

    Akshay

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    您好、 Akshay、

    感谢您确认内容。
    我期待您的回答。

    此致!

    市川达也

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    嗨、市川山、

    在 PWM 输入端出现新的上升沿后或在 t_RETRY 之后(以先发生者为准)清除故障。 清除故障的速度可能取决于 PWM 信号的频率。 您要为 PWM 使用多高的时钟速率? 另请注意、nFAULT 只会在  新的 PWM 输入之后通过数字逻辑延迟后变为高电平、因此 nFAULT 拉低至高电平之间的时间将与拉低与 PWM 输入变为高电平之间的时间不同。

    此致!

    Davis

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    您好、 Davis:

    感谢您回答我的问题。

    >PWM 使用的时钟速率是多少?

     →PWM 频率为20kHz。

    此致!

    市川达也

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    嗨、市川山、  

    根据 PWM 频率、 识别 nFAULT 与在 PWM 上输入新的上升沿之间至少有50us 的时间、这应该是足够的时间。 对于 DRV8353、该器件的 SPI 版本可以选择 t_RETRY = 50us、因此您的 PWM 信号应该没有问题。

    此致!

    Davis

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    您好、 Davis:

    如果故障在 PWM 的上升沿输出、则在下一个上升沿发生之前、实际上能够在最长50us 内清除故障。

    但是、可能存在在 PWM 周期的中点输出故障的情况。 在这种情况下、可以使用以下公式计算清除故障所需的时间:
    50usec / 2 = 25usec

    我想知道的是、输出故障后能够清除故障的最小时间是多久?

    此致!

    市川达也

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    嗨、市川山、

    抱歉、我假设您在监视故障、然后传播 PWM 周期进行响应。 我们没有指定 nFAULT 变为低电平后的时长、因为信号是输出且不需要抗尖峰脉冲。 只要器件识别到 nFAULT 变为低电平后 PWM 已从低电平变为高电平、就应清除故障。 为保证安全、可能需要等待1usec。 器件识别新的 PWM 输入与释放 nFAULT 之间的时间长度取决于通过数字逻辑的传播。

    此致!

    Davis

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    您好、 Davis:

    感谢您的答复。 我理解了内容。  

    此致!

    市川达也