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[参考译文] DRV8908-Q1:DRV8908-Q1中的 PWM 输出期间、nSLEEP 引脚是否可以为低电平?

Guru**** 2398135 points
Other Parts Discussed in Thread: DRV8908-Q1

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/motor-drivers-group/motor-drivers/f/motor-drivers-forum/1437275/drv8908-q1-can-nsleep-pin-be-low-during-pwm-output-in-drv8908-q1

器件型号:DRV8908-Q1

工具与软件:

各位专家、您好!

DRV8908-Q1中的 PWM 输出期间、nSLEEP 引脚是否可以拉至低电平?

对此有什么担忧吗?

谢谢!

Kento

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    您好、Kento、

    请给我们24小时的时间来了解这件事并与您联系。

    此致!

    Keerthi

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好 Keerthivasan、

    您能很快回答这个问题吗?

    谢谢!

    Kento

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    您好、Kento、

    通常、在器件正在驱动 OUTx 时将 nSLEEP 拉至低电平不是问题。 但是、这取决于所驱动的负载。 例如、电机可能会在减速时产生足够的 BEMF 电压以泵送 VM 电压、并可能超出器件的绝对最大额定值。 可以通过 VM 上有足够的大容量电容或在将 nSLEEP 拉至低电平之前使电机减速来缓解该问题。  

    此致、

    约书亚