[参考译文] CCS/MSP430FR2033：MSP430FR2033 MCLK工作频率不超过2MHz

你好，SHRAVAN BOMMU，

您是否可以共享测试代码？

您是否尝试过FR413x_FR203x CS代码示例？

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// MSP430FR413x演示-为MCLK配置源自DCO的8MHz。
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说明：默认DCODIV是MCLK和SMCLK源。
//默认情况下，FR413x选择XT1作为FLL参考。
//如果存在XT1，则需要配置XIN和XOUT引脚。
//如果XT1不存在，则切换为自动选择REFO作为FLL引用。
//在本例中，XT1被视为不存在。
// f (DCOCLK)= 2^FLLD *(FLLN+1)*(fFLLREFCLK / n)。
// FLLD = 0，FLLN =243，n=1，DIVM =1，f (DCOCLK)= 2^0 *(243+1)*3.2768万Hz = 8MHz，
// f (DCODIV)=(243+1)*3.2768万Hz = 8MHz，
// ACLK =默认REFO ~3.2768万Hz，SMCLK = 8LK = DK (DCOK)
//切换LED指示程序正在运行。
////
MSP430FR4133
// --------
// /|\\| |//
|| |//
--|RST |//
| WFP 1.0 |-->LED
// | WFP 1.4 |-->MCLK = 8MHz
// | WFP 8.0 |-->SMCLK =8MHz
// | 6.0 |-->ACLK = 3.2768万Hz
////

威廉高
//德州仪器(TI)
// 2014年3月// 8.1
采用IAR嵌入式工作平台v 6.10 & Code Composer Studio v
//******************************************************************************构建
#include <MSP430-h>

int main (void)
{
WDTCTL = WDTPW | WDTHOLD； //停止看门狗计时器

__bis_sr_register (SCG0)； //禁用FLL
CSCTL3 |= SELREF_REFCLK； //将REFO设置为FLL参考源
CSCTL0 = 0； //清除DCO和MOD寄存器
CSCTL1 &=~(DCORSEL_7)； //首先清除DCO频率选择位
CSCTL1 |= DCORSEL_3; //设置DCO = 8MHz
CSCTL2 = FLLD_0 + 243； // DCODIV = 8MHz
__DELAY周期(3)；
__BIC_SR_REGISTER (SCG0)； //启用FLL
while (CSCTL7和(FLLUNLOCK0 | FLLUNLOCK1))；//轮询，直到FLL锁定


CSCTL4 = SELMS__DCOCLKDIV | LAST__REFCLK；//将默认的REFO (~3.2768万Hz)设置为ACLK源，ACLK =3.2768万Hz
//默认DCODIV为MCLK和SMCLK源

P1DIR || BIT0 | BIT4； //将MCLK和LED引脚设置为输出
P1SEL0 |= BIT4； //将MCLK引脚设置为第二个功能
P8DIR || BIT0 | BIT1； //将ACLK和SMCLK引脚设置为输出
P8SEL0 || BIT0 | BIT1； //将ACLK和SMCLK引脚设置为第二功能

PM5CTL0 &=~LOCKLPM2； //禁用GPIO开机默认高阻抗模式
//以激活先前配置的端口设置

同时(1)
｛
P1OUT ^= BIT0； //使用excluse-or切换WFP 1.0
__DELAY周期(1000万)； // 1000万*(1/MCLK)=1.25s
的延迟}
}

巴西，

林氏六音