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[参考译文] MSP430FR2355：ADC 的总采样周期

admin
Guru**** 2551110 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/789238/msp430fr2355-total-sampling-cycles-of-adc

器件型号：MSP430FR2355

您好！

客户希望了解计算 ADC 总采样周期的方法。

ADC 配置：

                    分辨率：12位
     时钟频率(fADCCLK)：4.4MHz
      转换序列模式：通道的重复序列
 采样保持时间(ADCSHTx)：4个 ADCCLK 周期
输入通道选择(ADCINCHx)：4通道

      采样周期： 4 clk
同步周期： 1 clk
    转换周期：14 clk

每个通道4 + 1 + 14 = 19 clk。
19clk * 4ch = 76clk /所有4个通道。

问题1. 每个 4通道76个时钟周期的计算公式是否正确？

问题2. ADC 采样保持时间对 ADC 结果有何影响？

此致、

  • 0
    TI__Guru**** 2551110 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Q1：计算正确。
    Q2：ADC 采样保持时间(周期)在 ADCCTL0.ADCSHTx 上设置、采样时间应等于或大于 tSample "表5-21。 ADC、时序参数"、以保证采样效果

    ADC 采样保持时间(周期)在 ADCCTL0.ADCSHTx 上被设定
    同时、采样时间应等于或大于 tSample "表5-21。 "ADC、时序参数"。
    TSample 与外部等效 C 和 R 相关
    在 DS 中、假设(正常)条件下给出了0.61uS。
    在本例中、采样时间= 4/4.4MHz = 0.91uS。 它应该大于0.61uS。