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[参考译文] MSP430F5438A：P5.3/X2OUT GPIO 输入特性

admin
Guru**** 2561140 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/602546/msp430f5438a-p5-3-x2out-gpio-input-characteristic

器件型号：MSP430F5438A

您好！

我的客户(500k/年)询问一个开路引脚的特性。

它们使 P5.3/XT2OUT 引脚保持开路、并设置 引脚 GPIO 输入。 它们没有设置任何 其他寄存器。

当他们读取  P5IN 寄存器的 BIT3时、到 目前为止始终显示为1。

1. P5IN.3在 硬件和软件设置时是否始终为高电平？

2. TI 能否与我的客户分享内部方框图/原理图？ 版本比数据表更详细。

此致、

TED

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    TI__Guru**** 2561140 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    浮点输入绝不是一个好主意。 最好将未使用的输入连接到 DVcc 或 GND。 或者将其配置为低电平或高电平输出。
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    TI__Guru**** 2561140 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    是的、你是对的。 但是、他们已经启动了 MP、却没有注意到它、这就是他们需要 P5.3特性的原因
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    TI__Guru**** 2561140 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    尊敬的 Ted：

    TI 建议在未使用时将 XT2OUT 引脚保持断开状态并驱动为 GPIO 输出。 由于保留为浮动输入、因此您不能期望它保持高电平或低电平状态。 数据表第5.7-5.9节和6.10.6-6.10.7节未提供任何特性。

    此致、
    Ryan
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    TI__Guru**** 2561140 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    当处于 GPIO 模式时、P5.3与任何其他 GPIO 引脚没有区别。

    您无需更详细的原理图；CMOS 输入始终连接到 NMOS 和 PMOS 晶体管的栅极。 请参阅《慢速或浮点 CMOS 输入的影响》(SCBA004)的图1。

    该引脚悬空。 没有什么可以将其保持在任何特定电平；在该特定电路中、读数恰好为高电平、但这可能不是适当的高电平、而是恰好高于阈值的东西。 您不能依赖过去的 observations；最小的噪声量会使输入变为低电平。 在任何情况下、会有跨电流随着时间的推移而导致损坏、如果引脚悬空在阈值附近、开关电流可能会变得更高、并且振荡可能会导致电力线上产生过多噪声、从而导致该芯片或其他芯片发生故障。

    必须通过更改软件或硬件来移除该悬空引脚。